參數(shù)資料
型號： XC6SLX45T-2FG484I
廠商： Xilinx Inc
文件頁數(shù)： 61/89頁
文件大小： 0K
描述： IC FPGA SPARTAN 6 484FGGBGA
標(biāo)準(zhǔn)包裝： 60
系列： Spartan® 6 LXT
LAB/CLB數(shù)： 3411
邏輯元件/單元數(shù)： 43661
RAM 位總計(jì)： 2138112
輸入/輸出數(shù)： 296
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 484-BBGA
供應(yīng)商設(shè)備封裝： 484-FBGA
Spartan-6 FPGA Data Sheet: DC and Switching Characteristics
DS162 (v3.0) October 17, 2011
Product Specification
64
Table 59: Switching Characteristics for the Phase-Shift Clock in Variable Phase Mode(1)
Symbol
Description
Amount of Phase Shift
Units
Phase Shifting Range
When CLKIN < 60 MHz, the maximum allowed
number of DCM_DELAY_STEP steps for a
given CLKIN clock period, where T = CLKIN
clock period in ns. When using
CLKIN_DIVIDE_BY_2 = TRUE, double the
clock-effective clock period.
±(INTEGER(10 x (TCLKIN – 3 ns)))
steps
When CLKIN
60 MHz, the maximum allowed
number of DCM_DELAY_STEP steps for a
given CLKIN clock period, where T = CLKIN
clock period in ns. When using
CLKIN_DIVIDE_BY_2 = TRUE, double the
clock-effective clock period.
±(INTEGER(15 x (TCLKIN – 3 ns)))
steps
FINE_SHIFT_RANGE_MIN
Minimum guaranteed delay for variable phase
shifting.
±(MAX_STEPS x DCM_DELAY_STEP_MIN)
ps
FINE_SHIFT_RANGE_MAX
Maximum guaranteed delay for variable phase
shifting
±(MAX_STEPS x DCM_DELAY_STEP_MAX)
ps
Notes:
1.
The values in this table are based on the operating conditions described in Table 53 and Table 58.
2.
The maximum variable phase shift range, MAX_STEPS, is only valid when the DCM has no initial fixed-phase shifting, that is, the PHASE_SHIFT
attribute is set to 0.
3.
The DCM_DELAY_STEP values are provided at the end of Table 54.
Table 60: Miscellaneous DCM Timing Parameters(1)
Symbol
Description
Min
Max
Units
DCM_RST_PW_MIN
Minimum duration of a RST pulse width
3
–
CLKIN cycles
Notes:
1.
This limit only applies to applications that use the DCM DLL outputs (CLK0, CLK90, CLK180, CLK270, CLK2X, CLK2X180, and CLKDV). The DCM
DFS outputs (CLKFX, CLKFXDV, CLKFX180) are unaffected.
Table 61: Frequency Synthesis
Attribute
Min
Max
CLKFX_MULTIPLY (DCM_SP)
2
32
CLKFX_DIVIDE (DCM_SP)
1
32
CLKDV_DIVIDE (DCM_SP)
1.5
16
CLKFX_MULTIPLY (DCM_CLKGEN)
2
256
CLKFX_DIVIDE (DCM_CLKGEN)
1
256
CLKFXDV_DIVIDE (DCM_CLKGEN)
2
32
Table 62: DCM Switching Characteristics
Symbol
Description
Speed Grade
Units
-3
-3N
-2
-1L
TDMCCK_PSEN/ TDMCKC_PSEN
PSEN Setup/Hold
1.50/
0.00
1.50/
0.00
1.50/
0.00
1.50/
0.00
ns
TDMCCK_PSINCDEC/ TDMCKC_PSINCDEC
PSINCDEC Setup/Hold
1.50/
0.00
1.50/
0.00
1.50/
0.00
1.50/
0.00
ns
TDMCKO_PSDONE
Clock to out of PSDONE
1.50
ns
相關(guān)PDF資料
PDF描述
XC6SLX45T-2FGG484I IC FPGA SPARTAN 6 43K 484FGGBGA
25LC080D-E/ST IC SRL EEPROM 1KX8 2.5V 8-TSSOP
25LC080C-E/MS IC SRL EEPROM 1KX8 2.5V 8-MSOP
XC6SLX45T-N3CSG484I IC FPGA SPARTAN-6 484CSBGA
25AA320AXT-I/ST IC EEPROM 32KBIT 10MHZ 8TSSOP
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
XC6SLX45T-2FGG484C 功能描述:IC FPGA SPARTAN 6 43K 484FGGBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:Spartan® 6 LXT 標(biāo)準(zhǔn)包裝:60 系列:XP LAB/CLB數(shù):- 邏輯元件/單元數(shù):10000 RAM 位總計(jì):221184 輸入/輸出數(shù):244 門數(shù):- 電源電壓:1.71 V ~ 3.465 V 安裝類型:表面貼裝 工作溫度:0°C ~ 85°C 封裝/外殼:388-BBGA 供應(yīng)商設(shè)備封裝:388-FPBGA（23x23） 其它名稱:220-1241
XC6SLX45T-2FGG484CES9982 制造商:Xilinx 功能描述:
XC6SLX45T-2FGG484I 功能描述:IC FPGA SPARTAN 6 43K 484FGGBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:Spartan® 6 LXT 標(biāo)準(zhǔn)包裝:40 系列:Spartan® 6 LX LAB/CLB數(shù):3411 邏輯元件/單元數(shù):43661 RAM 位總計(jì):2138112 輸入/輸出數(shù):358 門數(shù):- 電源電壓:1.14 V ~ 1.26 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:676-BGA 供應(yīng)商設(shè)備封裝:676-FBGA（27x27）
XC6SLX45T-2FGG676C 制造商:Xilinx 功能描述:
XC6SLX45T-2FGG676I 制造商:Xilinx 功能描述:
發(fā)布緊急采購，3分鐘左右您將得到回復(fù)。

采購需求

(若只采購一條型號，填寫一行即可)

發(fā)布成功！您可以繼續(xù)發(fā)布采購。也可以進(jìn)入我的后臺，查看報(bào)價(jià)

發(fā)布成功！您可以繼續(xù)發(fā)布采購。也可以進(jìn)入我的后臺，查看報(bào)價(jià)

*型號 *數(shù)量 廠商 批號 封裝
添加更多采購

我的聯(lián)系方式

*
*
*