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參數(shù)資料
| 型號： | UPD78F0537GB(A)-GAH-AX |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQFP64 |
| 封裝： | 10 X 10 MM, LEAD FREE, PLASTIC, LQFP-64 |
| 文件頁數(shù)： | 475/649頁 |
| 文件大?。?/td> | 5363K |
| 代理商： | UPD78F0537GB(A)-GAH-AX |
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CHAPTER 21 STANDBY FUNCTION
User’s Manual U17260EJ6V0UD
526
Table 21-3. Operating Statuses in STOP Mode
When STOP Instruction Is Executed While CPU Is Operating on Main System Clock
STOP Mode Setting
Item
When CPU Is Operating on
Internal High-Speed
Oscillation Clock (fRH)
When CPU Is Operating on
X1 Clock (fX)
When CPU Is Operating on
External Main System Clock
(fEXCLK)
System clock
Clock supply to the CPU is stopped
fRH
fX
Stopped
Main system clock
fEXCLK
Input invalid
fXT
Status before STOP mode was set is retained
Subsystem clock
fEXCLKS
Operates or stops by external clock input
fRL
Status before STOP mode was set is retained
CPU
Operation stopped
Flash memory
Operation stopped
RAM
Status before STOP mode was set is retained
Port (latch)
Status before STOP mode was set is retained
00
Note1
16-bit timer/event
counter
01
Notes1, 2
Operation stopped
50
Note1
Operable only when TI50 is selected as the count clock
8-bit timer/event
counter
51
Note1
Operable only when TI51 is selected as the count clock
H0
Operable only when TM50 output is selected as the count clock during 8-bit timer/event counter
50 operation
8-bit timer
H1
Operable only when fRL, fRL/2
7, fRL/29 is selected as the count clock
Watch timer
Operable only when subsystem clock is selected as the count clock
Watchdog timer
Operable. Clock supply to watchdog timer stops when “internal low-speed oscillator can be
stopped by software” is set by option byte.
Clock output
Operable only when subsystem clock is selected as the count clock
Buzzer output
A/D converter
Operation stopped
UART0
UART6
Operable only when TM50 output is selected as the serial clock during 8-bit timer/event counter
50 operation
CSI10
Note1
CSI11
Notes1, 2
Operable only when external clock is selected as the serial clock
Serial interface
IIC0
Note1
Operable only when the external clock from EXSCL0/P62 pin is selected as the serial clock
Multiplier/divider
Note2
Operation stopped
Power-on-clear function
Low-voltage detection function
External interrupt
Operable
Notes 1. Do not start operation of these functions on the external clock input from peripheral hardware pins in the
stop mode.
2. PD78F0534, 78F0535, 78F0536, 78F0537, and 78F0537D only.
Remark
fRH:
Internal high-speed oscillation clock
fX:
X1 clock
fEXCLK:
External main system clock
fXT:
XT1 clock
fEXCLKS: External subsystem clock
fRL:
Internal low-speed oscillation clock
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| UPD78F0537GB-UEU-A | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD78F0537GC(T)-UBS-A | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD78F0537GC-UBS-A | 制造商:Renesas Electronics Corporation 功能描述:78K0/KE2, 128K FLASH, 7KB RAM - Bulk 制造商:Renesas Electronics Corporation 功能描述:NECUPD78F0537GC-UBS-A 78K0/KE2 128K FLAS |
| UPD78F0537GK(T)-UET-A | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD78F0537GK-UET-A | 制造商:Renesas Electronics Corporation 功能描述: |
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