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參數(shù)資料
| 型號： | UPD789417AGK-XXX-9EU |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 5 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | 12 X 12 MM, PLASTIC, TQFP-80 |
| 文件頁數(shù)： | 80/320頁 |
| 文件大?。?/td> | 2550K |
| 代理商： | UPD789417AGK-XXX-9EU |
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CHAPTER 12 COMPARATOR
170
User’s Manual U13952EJ3V1UD
Figure 12-5. Comparator Operation Timing (1/2)
Timer (TM02)
output
CMPOUT0
CMPTOUT0
SELCMP0
Timer (TM02)
output enable
signal
<1> CMPOUT0 is latched on the rising edge of the TM02 output to generate a signal to enable output to the
CMPTOUT0/P23/TO2 pin.
If CMPOUT0 is high, the TM02 output waveform is output to the
CMPTOUT0/P23/TO2 pin on the rising edge of the TM02 output. If CMPOUT0 is low, CMPTOUT0 is not
output.
<2> If SELCMP0 is low, the TM02 output is sent to the CMPTOUT0/P23/TO2 pin no matter which level
CMPOUT0 is on.
Figure 12-5. Comparator Operation Timing (2/2)
Timer (TM02)
output
CMPOUT0
CMPTOUT0
SELCMP0
Timer (TM02)
output enable
signal
<3> If the high level of CMPOUT0 is latched on the rising edge of the TM02 output, CMPTOUT0 is output to the
CMPTOUT0/P23/TO2 pin for at least two clock pulses even if it falls immediately.
<4> Switching SELCMP0 from high to low during CMPTOUT0 output may disturb the output waveform of
CMPTOUT0.
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