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參數(shù)資料
| 型號： | UPD789022GB-XXX-8ES-A |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 5 MHz, MICROCONTROLLER, PQFP44 |
| 封裝： | 10 X 10 MM, PLASTIC, LQFP-44 |
| 文件頁數(shù)： | 16/221頁 |
| 文件大?。?/td> | 1619K |
| 代理商： | UPD789022GB-XXX-8ES-A |
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CHAPTER 8 WATCHDOG TIMER
User’s Manual U11919EJ4V0UD
112
(2)
Watchdog timer mode register (WDTM)
This register sets the operation mode of the watchdog timer, and enables/disables counting of the watchdog
timer.
WDTM is set with a 1-bit or 8-bit memory manipulation instruction.
RESET input clears WDTM to 00H.
Figure 8-3. Format of Watchdog Timer Mode Register
RUN
0
1
Watchdog timer operation selectionNote 1
RUN
0
WDTM4
WDTM3
0
WDTM
Symbol
Address
After reset
R/W
FFF9H
00H
R/W
<7>
6543
2
1
0
Stop counting.
Clear counter and start counting.
WDTM4
Watchdog timer operation mode selectionNote 2
WDTM3
0
1
0
1
Operation stop
Interval timer mode (overflow and maskable interrupt occur)Note 3
Watchdog timer mode 1 (overflow and non-maskable interrupt occur)
Watchdog timer mode 2 (overflow occurs and reset operation started)
0
Notes 1. Once RUN has been set to 1, it cannot be cleared to 0 by software. Therefore, when counting is
started, it cannot be stopped by any means other than RESET input.
2. Once WDTM3 and WDTM4 have been set to 1, they cannot be cleared to 0 by software.
3. The watchdog timer starts operation as an interval timer when RUN is set to 1.
Cautions 1. When the watchdog timer is cleared by setting RUN to 1, the actual overflow time is up
to 0.8% shorter than the time set by timer clock select register 2 (TCL2).
2. In watchdog timer mode 1 or 2, set WDTM4 to 1 after confirming that TMIF4 (bit 0 of
interrupt request flag register 0 (IF0)) is set to 0. When watchdog timer mode 1 or 2 is
selected under the condition where TMIF4 is 1, a non-maskable interrupt occurs at the
completion of rewriting.
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