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參數(shù)資料
| 型號： | UPD16878GS-BGG |
| 廠商： | NEC Corp. |
| 英文描述： | MONOLITHIC QUAD H BRIDGE DRIVER CIRCUIT |
| 中文描述： | 單片四H橋驅(qū)動電路 |
| 文件頁數(shù)： | 11/32頁 |
| 文件大?。?/td> | 242K |
| 代理商： | UPD16878GS-BGG |
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Data Sheet S15974EJ1V0DS
11
μ
PD16878
<7th byte> <7th byte>
Bit
Data
Function
Setting
Bit
Data
Function
Setting
D7
D7
1 or 0
Current Set
β
set2/set1
D6
D6
D5
D5
D4
4-bit data
input
β
ch
Current Set2
β
ch Output
current setting 2
EVR: 100 to 250 mV
Setting (0 to 15)
Note
D4
D3
D3
D2
D2
D1
D1
D0
4-bit data
input
β
ch
Current Set1
β
ch Output
current setting 1
EVR: 100 to 250 mV
Setting (0 to 15)
Note
D0
15-bit data
High-order
7-bit data
input
β
Pulse Width
β
ch pulse
cycle:
0.25 to 8191.75
μ
s
Setting
(1 to 32767)
t = 0.25
μ
s
Note
A voltage of about double EVR is output to
the FIL pin.
<8th byte>
<8th byte>
Bit
Data
Function
Setting
Bit
Data
Function
Setting
D7
1 or 0
D7
1 or 0
D6
1 or 0
D6
1 or 0
D5
1 or 0
D5
1 or 0
D4
1 or 0
D4
1 or 0
D3
1 or 0
D3
1 or 0
D2
1 or 0
D2
1 or 0
D1
1 or 0
D1
1 or 0
D0
1 or 0
Checksum
Checksum
Note
D0
1 or 0
Checksum
Checksum
Note
Note
Data is input so that the sum of the 1st
through the 8th bytes is 00H.
Note
Data is input so that the sum of the 1st
through the 8th bytes is 00H.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD16878 | MONOLITHIC QUAD H BRIDGE DRIVER CIRCUIT |
| UPD16879GS-BGG | MONOLITHIC QUAD H BRIDGE DRIVER CIRCUIT |
| UPD16879 | MONOLITHIC QUAD H BRIDGE DRIVER CIRCUIT |
| UPD1703C-011 | PHASE LOCKED LOOP FREQUENCY SYNTHESIZER FM/AM DIGITAL TUNING SYSTEM CONTROLLER CMOS LSI |
| UPD1703C-013 | PHASE LOCKED LOOP FREQUENCY SYNTHESIZER FM/AM DIGITAL TUNING SYSTEM CONTROLLER CMOS LSI |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| UPD16879 | 制造商:NEC 制造商全稱:NEC 功能描述:MONOLITHIC QUAD H BRIDGE DRIVER CIRCUIT |
| UPD16879GS-BGG | 制造商:NEC 制造商全稱:NEC 功能描述:MONOLITHIC QUAD H BRIDGE DRIVER CIRCUIT |
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