參數(shù)資料
型號： TMXF28155
英文描述： TMXF28155 Super Mapper 155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
中文描述： TMXF28155超級映射五十一分之一百五十五Mbits /秒的SONET / SDH x28/x21的DS1/E1
文件頁數(shù)： 559/606頁
文件大?。?/td> 9520K
代理商： TMXF28155
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Preliminary Data Sheet
May 2001
TMXF28155/51 Super Mapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
559
Agere Systems Inc.
22 Cross Connect (XC) Block Functional Description
(continued)
5-9188(F)r.3
Figure 89. M12 MUX DS2 Output Cross Connect
There is another way to route DS2 signals for M12 MUX
’
s through LINETXDATA and LINETXCLK pins, if available,
by setting the block ID of XC_PDATA_Source_ID to 111 (refer to the Table on
page 550
). This configuration is capa-
ble of supporting DS2 demand clocking operation. In DS2 demand clocking mode, the LINETXCLK pins act as out-
puts; otherwise, they are input pins carrying incoming DS2 clocks. Depending on the clocking scheme, the channel
ID can be set up based on the following tables.
Table 619. XC_PDATA Source IDs for LINETXDATA Routing with Source Block = 111
Table 620. XC_PDATA Source IDs for LINETXCLK Routing with Source Block = 111
I/O Ch.
O
O
O
O
O
O
O
O
Description
Reserved
M12_DS2DAT_1
M12_DS2DAT_2
M12_DS2DAT_3
M12_DS2DAT_4
M12_DS2DAT_5
M12_DS2DAT_6
M12_DS2DAT_7
I/O Ch.
O
O
O
O
O
O
O
O
Description
Reserved
M12_DS2DAT_1
M12_DS2DAT_2
M12_DS2DAT_3
M12_DS2DAT_4
M12_DS2DAT_5
M12_DS2DAT_6
M12_DS2DAT_7
I/O Ch.
O
O
O
O
O
O
O
O
Description
Reserved
M12_DS2DAT_1
M12_DS2DAT_2
M12_DS2DAT_3
M12_DS2DAT_4
M12_DS2DAT_5
M12_DS2DAT_6
M12_DS2DAT_7
I/O Ch. Description
O
24
O
25
O
26
O
27
O
28
O
29
O
30
O
31
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
I/O Ch.
O
O
O
O
O
O
O
O
Description
Reserved
DS2_AISCLK
DS2_AISCLK
DS2_AISCLK
DS2_AISCLK
DS2_AISCLK
DS2_AISCLK
DS2_AISCLK
I/O Ch.
O
O
O
O
O
O
O
O
Description
Reserved
DM12_DS2CLK_1
DM12_DS2CLK_2
DM12_DS2CLK_3
DM12_DS2CLK_4
DM12_DS2CLK_5
DM12_DS2CLK_6
DM12_DS2CLK_7
I/O Ch.
O
I
I
I
I
I
I
I
Description
Reserved
M12_DS2CLK[7:1]
input through
LINETXCLK pins,
the actual routings
are determined by
XC2_DS2M12CLK
SOURCE ID
I/O Ch. Description
O
24
O
25
O
26
O
27
O
28
O
29
O
30
O
31
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
M13
XC
EXTERNAL I/O
M12_DS2_DATA_OUT
XC2_DS2M12CLK
LINETXSYNC[7
—
1]
LINETXSYNC[14
—
8]
XC2_DS2M12CLK[1
—
7][7:0]
XC_SYNC[1
—
29][7:0]
SOURCE_ID = 000
CHANNEL_ID 9 TO 15
XC1
XC2
LINETXDATA[29
—
1]
LINERXCLK[29
—
1]
DS2_AISCLK
XC_DATA[1
—
29][7:0]
SOURCE_ID = 111
CHANNEL_ID 1TO 7
LINETXCLK[29
—
1]
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