參數(shù)資料
型號(hào)： TMXF281553BAL-3C-DB
元件分類(lèi)： 通信、網(wǎng)絡(luò)模塊及開(kāi)發(fā)工具
英文描述： Telecomm/Datacomm
中文描述： 電信/數(shù)據(jù)通信
文件頁(yè)數(shù)： 278/784頁(yè)
文件大小： 10831K
代理商： TMXF281553BAL-3C-DB
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155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
June 2002
278
Agere Systems Inc.
TMXF28155/51 Supermapper
Data Sheet
12 28-Channel Framer Registers
(continued)
* See
Table 388 on page 275
for values of L and T.
12.10 Performance Monitor Per Link Registers
The following tables describe the functions of all bits in the register map. Counters are programmable to either
roll over or saturate, and may be programmed to clear on read.
Registers are only provisionable to clear-on-read (COR).
For each address, the register bits are identified as either read/write (R/W) or read only (RO), and the value of the
bits on reset are given.
Table 392. Performance Monitor Per Link Register Addressing Map
* L and P represent hexidecimal digits used for absolute addressing in
Table 394
through
Table 413
.
0x8LT21
6
FRM_T_TXSTOMP
Tx Path Stomping.
For DS1 links, this bit indicates to stomp
all robbed-bit signaling on voice time slots on the corre-
sponding link to 0. Stomping time slot 16 for CEPT links is
done by inserting all ones using the signaling registers. A 1
will enable stomping. A 0 will disable stomping for the corre-
sponding link.
Reserved.
Must write to 0.
Handling Group Enable.
When set to 1 in combination with
(bit 9, FRM_T_VTSIGE), this bit indicates to the signaling
block that the signaling for this link is byte sync mapped and
uses the handling group format.
Manual Signaling Freeze.
Used to manually halt the signal-
ing register updates when the source of signaling data is
either the Rx system or the Rx line. A 1 halts the updates.
F and G Source
. Indicates which entity will be the source
for the F and G values used in handling the ABCD bits.
0 = host programmed.
1 = sourced from the Rx system interface.
The F and G programming can be implied by the system
interface only when using the ASM CHI or the parallel sys-
tem interface.
FRM_T_SIGSRC[1:0]
Signaling Data Source.
Indicates which of the entities will
be the source for the ABCD bits.
00 = signaling programmed by the host.
01 = signaling extracted from the Rx line.
10 = signaling received from the system interface.
0
5
4
RSVD
0
0
FRM_T_HGEN
3
FRM_T_MSIGFZ
0
2
FRM_T_FGSRC
0
1:0
00
Address Pins (ADDR15—ADDR0)
9
8
LNK1
LNK0
RXP = 0
TXP = 1
P*
15
0
14
0
13
12
11
10
7
1
6
0
5
4
3
2
1
0
LNK4
LNK3
LNK2
PM5 PM4 PM3 PM2 PM1 PM0
L*
—
Table 391. FRM_TSLR32, Transmit Signaling Link Register 32 (R/W)
(continued)
Address
*
Bit
Name
Function
Reset
Default
相關(guān)PDF資料
PDF描述
TFRA28J133BAL-1 Transient Voltage Suppressor Diodes
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
TMXF336251BL-3-DB 制造商:LSI Corporation 功能描述:Mapper DS3/E3/DS0/E0 SONET/SDH 155Mbps/622Mbps 1.5V/3.3V 1152-Pin BGA Bag 制造商:LSI 功能描述:Mapper DS3/E3/DS0/E0 SONET/SDH 155Mbps/622Mbps 1.5V/3.3V 1152-Pin BGA Bag
TMXF84622 制造商:AGERE 制造商全稱(chēng):AGERE 功能描述:TMXF84622 155 Mbits/s/622 Mbits/s Interface SONET/SDH x84/x63 Ultramapper
TMXF846221BL-3-DB 制造商:LSI Corporation 功能描述:Mapper DS3/E3/DS2/DS1/DS0/E1 SONET/SDH 155Mbps/622Mbps 1.5V/3.3V 700-Pin BGA Bag
TMXM-0-49 制造商:Brady Corporation 功能描述:
TMXM-11 制造商:Brady Corporation 功能描述:
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