參數(shù)資料
型號： TMXF281553BAL-3C-DB
元件分類： 通信、網(wǎng)絡(luò)模塊及開發(fā)工具
英文描述： Telecomm/Datacomm
中文描述： 電信/數(shù)據(jù)通信
文件頁數(shù)： 17/784頁
文件大?。?/td> 10831K
代理商： TMXF281553BAL-3C-DB
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17
Agere Systems Inc.
Data Sheet
June 2002
TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
3 Pin Information
(continued)
3.3 Pin Descriptions
3.3.1 High-Speed I/O Pin Descriptions
The high-speed I/O consists of five LVDS signals (10 pins) that connect the Supermapper to an external OC-3
optics device. It exchanges an STS-3 or STM-1 signal between the TMUX and an OC-3 transceiver. The Super-
mapper is capable of recovering a clock from the receive data, or it can accept a clock recovered externally by the
optics device. If internal clock recovery is used, the Supermapper uses THSCP/N as a reference.
The high-speed I/O may also run at 52.84 Mbits/s in applications that terminate an STS-1 or EC-1 signal. In this
case, the (electrical) line signals are typically terminated by a line interface unit (LIU) chip. The operating speed of
the high-speed I/O is determined by TMUX_RCV_TX_MODE.
Table 3. High-Speed I/O Pin Descriptions
Pin
AF7,
AE7
Symbol
RHSDP
RHSDN
Type
LVDS
I/O
I
Description
Receive High-Speed Data.
155.52 Mbits/s serial data input in STS-1 or
STM-1 format, or 51.84 Mbits/s data in STS-1 format. If RHSD is not used
(in a slave Supermapper, for example), the P input should be pulled high
through a 1 k
resistor and the N input pulled low through a 1 k
resistor.
RHSD is typically provided by an OC-3 receiver, an STS-1 line interface
unit, or a higher-order (e.g., STS-12) demultiplexing chip.
Receive High-Speed Clock.
155.52 MHz or 51.84 MHz clock for STS-3
or STS-1 input data. Typically supplied by an external OC-3 optoelec-
tronic device, or an STS-1/EC1 line interface unit, synchronous with
RHSD. If the internal clock recovery (CDR) feature is enabled, RHC is not
required and should be connected to a 1 k
resistors to V
DD
(RHCP
input) and V
SS
(RHCN input).
Transmit High-Speed Clock.
Transmit 155.52 MHz or 51.84 MHz clock.
Master clock for the transmit sections of the TMUX, telecom bus, SPE,
and VT mappers. THSC is also used as a reference clock for the receive
CDR, if it is being used.
Transmit High-Speed Frame Synchronization.
An optional input that
may be used to specify the position of the transmit STS-3, STM-1, or
STS-1 frame. THSSYNC marks the position of bit 1 of the A1 byte, i.e.,
the first bit of the overhead in the THSD output. If THSSYNC is not used,
the P input should be pulled high through a 1 k
resistor, and the N input
pulled low through a 1 k
resistor. A typical application for this pin may
be to synchronize a group of Supermappers so that their STS-3 outputs
may be multiplexed into an STS-12 signal.
Transmit High-Speed Data.
Transmit output for STS-3, STM-1, or STS-
1 serial data. Typically connected to an OC-3 module or an LIU, if operat-
ing in STS-1 mode. May also be connected to a higher-order multiplexing
device, for example, STS-12.
AC7,
AD8
RHSCP
RHSCN
LVDS
I
AF8,
AE8
THSCP
THSCN
LVDS
I
AC8,
AD9
THSSYNCP
THSSYNCN
LVDS
I
AF9,
AE9
THSDP
THSDN
LVDS
O
相關(guān)PDF資料
PDF描述
TFRA28J133BAL-1 Transient Voltage Suppressor Diodes
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
TMXF336251BL-3-DB 制造商:LSI Corporation 功能描述:Mapper DS3/E3/DS0/E0 SONET/SDH 155Mbps/622Mbps 1.5V/3.3V 1152-Pin BGA Bag 制造商:LSI 功能描述:Mapper DS3/E3/DS0/E0 SONET/SDH 155Mbps/622Mbps 1.5V/3.3V 1152-Pin BGA Bag
TMXF84622 制造商:AGERE 制造商全稱:AGERE 功能描述:TMXF84622 155 Mbits/s/622 Mbits/s Interface SONET/SDH x84/x63 Ultramapper
TMXF846221BL-3-DB 制造商:LSI Corporation 功能描述:Mapper DS3/E3/DS2/DS1/DS0/E1 SONET/SDH 155Mbps/622Mbps 1.5V/3.3V 700-Pin BGA Bag
TMXM-0-49 制造商:Brady Corporation 功能描述:
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