參數(shù)資料
型號： TMS470R1A256PZ
廠商： Texas Instruments, Inc.
英文描述： 16/32-Bit RISC Flash Microcontroller
中文描述： 16/32位RISC閃存微控制器
文件頁數(shù)： 38/46頁
文件大?。?/td> 392K
代理商： TMS470R1A256PZ
www.ti.com
SCIn isosynchronous mode timings — external clock
timing requirements for external clock SCIn isosynchronous mode
(1)(2)
(see Figure 17)
1
3
2
6
7
Data Valid
Data Valid
SCICLK
SCITX
SCIRX
5
4
TMS470R1A256
16/32-Bit RISC Flash Microcontroller
SPNS100–NOVEMBER 2004
NO.
1
2
3
4
5
6
7
MIN
8t
c(ICLK)
MAX
UNIT
ns
ns
ns
ns
ns
ns
ns
t
c(SCC)
t
w(SCCH)
t
w(SCCL)
t
d(SCCH-TXV)
t
v(TX)
t
su(RX-SCCL)
t
v(SCCL-RX)
Cycle time, SCInCLK
(3)
Pulse duration, SCInCLK high
Pulse duration, SCInCLK low
Delay time, SCInCLK high to SCInTX valid
Valid time, SCInTX data after SCInCLK low
Setup time, SCInRX before SCInCLK low
Valid time, SCInRX data after SCInCLK low
0.5t
c(SCC)
- 0.25t
c(ICLK)
0.5t
c(SCC)
- 0.25t
c(ICLK)
0.5t
c(SCC)
+ 0.25t
c(ICLK)
0.5t
c(SCC)
+ 0.25t
c(ICLK)
2t
c(ICLK)
+ 12 + t
r
2t
c(SCC)
- 10
0
2t
c(ICLK)
+ 10
(1)
(2)
(3)
t
= interface clock cycle time = 1 / f
For rise and fall timings, see the "switching characteristics for output timings versus load capacitance" table.
When driving an external SCInCLK, the following must be true: t
c(SCC)
≥
8t
c(ICLK)
A.
Data transmission/reception characteristics for isosynchronous mode with external clocking are similar to the
asynchronous mode. Data transmission occurs on the SCICLK rising edge, and data reception on the SCICLK falling
edge.
Figure 17. SCIn Isosynchronous Mode Timing Diagram for External Clock
38
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參數(shù)描述
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