參數(shù)資料
型號： TMS470R1A256PZ
廠商： Texas Instruments, Inc.
英文描述： 16/32-Bit RISC Flash Microcontroller
中文描述： 16/32位RISC閃存微控制器
文件頁數(shù)： 37/46頁
文件大?。?/td> 392K
代理商： TMS470R1A256PZ
www.ti.com
SCIn ISOSYNCHRONOUS MODE TIMINGS INTERNAL CLOCK
timing requirements for internal clock SCIn isosynchronous mode
(1)(2)(3)
(see Figure 16)
1
2
3
6
7
Data Valid
SCICLK
SCITX
SCIRX
5
4
Data Valid
TMS470R1A256
16/32-Bit RISC Flash Microcontroller
SPNS100–NOVEMBER 2004
(BAUD + 1)
(BAUD + 1)
IS EVEN OR BAUD = 0
MIN
2t
c(ICLK)
IS ODD AND BAUD
≠
0
MIN
3t
c(ICLK)
NO.
UNIT
MAX
2
24
t
c(ICLK)
MAX
1
t
c(SCC)
Cycle time, SCInCLK
Pulse duration,
SCInCLK low
Pulse duration,
SCInCLK high
Delay time, SCInCLK
high to SCInTX valid
Valid time, SCInTX
data after SCInCLK
low
Setup time, SCInRX
before SCInCLK low
Valid time, SCInRX
data after SCInCLK
low
(2
24
-1) t
c(ICLK)
ns
2
t
w(SCCL)
0.5t
c(SCC)
- t
f
0.5t
c(SCC)
+ 5
0.5t
c(SCC)
+ 0.5t
c(ICLK)
- t
f
0.5t
c(SCC)
+ 0.5t
c(ICLK)
ns
3
t
w(SCCH)
0.5t
c(SCC)
- t
r
0.5t
c(SCC)
+ 5
0.5t
c(SCC)
- 0.5t
c(ICLK)
- t
r
0.5t
c(SCC)
- 0.5t
c(ICLK)
ns
4
t
d(SCCH-TXV)
10
10
ns
5
t
v(TX)
t
c(SCC)
- 10
t
c(SCC)
- 10
ns
6
t
su(RX-SCCL)
t
c(ICLK)
+ t
f
+ 20
t
c(ICLK)
+ t
f
+ 20
ns
7
t
v(SCCL-RX)
- t
c(ICLK)
+ t
f
+ 20
- t
c(ICLK)
+ t
f
+ 20
ns
(1)
(2)
(3)
BAUD = 24-bit concatenated value formed by the SCI[H,M,L]BAUD registers.
t
= interface clock cycle time = 1 / f
For rise and fall timings, see the "switching characteristics for output timings versus load capacitance" table.
A.
Data transmission/reception characteristics for isosynchronous mode with external clocking are similar to the
asynchronous mode. Data transmission occurs on the SCICLK rising edge, and data reception on the SCICLK falling
edge.
Figure 16. SCIn Isosynchronous Mode Timing Diagram for Internal Clock
37
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參數(shù)描述
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