參數(shù)資料
型號： TMS320F243PGES
元件分類： 數(shù)字信號處理
英文描述： 16-Bit Digital Signal Processor
中文描述： 16位數(shù)字信號處理器
文件頁數(shù)： 79/116頁
文件大?。?/td> 1485K
代理商： TMS320F243PGES
TMS320F243, TMS320F241
DSP CONTROLLERS
SPRS064B – DECEMBER 1997 – REVISED FEBRUARY 1999
79
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
low-power mode timings
switching characteristics over recommended operating conditions [H = 0.5t
c(CO)
]
(see Figure 22, Figure 23, and Figure 24)
PARAMETER
LOW-POWER MODES
MIN
TYP
MAX
UNIT
td(WAKE A)
td(WAKE-A)
Delay time, CLKOUT switching to
program execution resume
IDLE1
LPM0
4 + 6 t(CO)
4 + 6 tc(CO)
15
t(CO)
tc(CO)
ns
td(IDLE-COH)
Delay
executed to CLKOUT high
time,
Idle
instruction
IDLE2
LPM1
4tc(CO)
ns
td(WAKE-OSC)
Delay time, wakeup interrupt
asserted to oscillator running
HALT
{PLL/OSC power down}
LPM2
OSC start-up
and PLL lock
time
ms
td(IDLE-OSC)
Delay
executed to oscillator power off
time,
Idle
instruction
4tc(CO)
μ
s
td(EX)
Delay time, reset vector executed
after RS high
36H
ns
WAKE INT
CLKOUT
A0–A15
td(WAKE–A)
Figure 22. IDLE1 Entry and Exit Timing – LPM0
td(WAKE–A)
td(IDLE–COH)
WAKE INT
CLKOUT
A0–A15
Figure 23. IDLE2 Entry and Exit Timing – LPM1
td(EX)
td(IDLE–COH)
td(IDLE–OSC)
áá
áá
RESET
CLKOUT
A0–A15
td(WAKE–OSC)
Figure 24. HALT Mode – LPM2
NOTE: WAKE INT can be any valid interrupt or RESET
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PDF描述
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