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參數(shù)資料
| 型號： | TMC22X5YA |
| 廠商： | Fairchild Semiconductor Corporation |
| 英文描述： | Multistandard Digital Video Decoder Three-Line Adaptive Comb Decoder Family, 8 & 10 bit |
| 中文描述： | 多標準數(shù)字視頻解碼器三線自適應梳狀解碼器系列，8 |
| 文件頁數(shù)： | 35/84頁 |
| 文件大?。?/td> | 417K |
| 代理商： | TMC22X5YA |
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PRODUCT SPECIFICATION
TMC22x5yA
REV. 1.0.0 2/4/03
35
Control Register De
fi
nitions
(continued)
Register
(38)
7
Y
9
6
Y
8
5
Y
7
4
Y
6
3
Y
5
2
Y
4
1
Y
3
0
Y
2
Reg
38
Bit
7-0
Name
Y
9-2
Description
Luma grab, 8 msbs.
Top 8 bits of the "grabbed" luma data after YPROC
Register
(39)
7
6
5
4
3
2
1
0
M
9
M
8
M
7
M
6
M
5
M
4
M
3
M
2
Reg
39
Bit
7-0
Name
M
9-2
Description
Msync grab, 8 msbs.
Top 8 bits of the "grabbed" mixed sync data after
YPROC
Register
(3A)
7
6
5
4
3
2
1
0
U
9
U
8
U
7
U
6
U
5
U
4
U
3
U
2
Reg
3A
Bit
7-0
Name
U
9-2
Description
U grab, 8 msbs.
Top 8 bits of the "grabbed" U data
Register
(3B)
7
V
9
6
V
8
5
V
7
4
V
6
3
V
5
2
V
4
1
V
3
0
V
2
Reg
3B
Bit
7-0
Name
V
9-2
Description
V grab, 8 msbs.
Top 8 bits of the "grabbed" V data
Register
(3C)
7
Y
1
6
Y
0
5
4
3
2
1
V
1
0
V
0
M
1
M
0
U
1
U
0
Reg
3C
3C
3C
3C
Bit
7-6
5-4
3-2
1-0
Name
Y
1-0
M
1-0
U
1-0
V
1-0
Description
Luma grab, 2 lsbs.
Bottom 2 bits of luma data
Msync grab, 2 lsbs.
Bottom 2 bits of mixed sync data
U grab, 2 lsbs.
Bottom 2 bits of U data
V grab, 2 lsbs.
Bottom 2 bits of V data
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PDF描述 |
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