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參數(shù)資料
| 型號： | TLV320AIC23BGQER |
| 廠商： | Texas Instruments, Inc. |
| 元件分類： | Codec |
| 英文描述： | STEREO AUDIO CODEC 8 TO 96 KHZ WITH INTEGRATED HEADPHONE AMPLIFIER |
| 中文描述： | 立體聲音頻編解碼8至96與集成耳機放大器KHZ可 |
| 文件頁數(shù)： | 28/50頁 |
| 文件大?。?/td> | 499K |
| 代理商： | TLV320AIC23BGQER |
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38
LRCIN/
LRCOUT
BCLK
DIN/
DOUT
n
n1
0
1
n1
n
1/fs
Left Channel
Right Channel
1
0
n
MSB
LSB
Figure 36. Left-Justified Mode Timing
3.3.1.3 I
2
S Mode
In I
2
S mode, the MSB is available on the second rising edge of BCLK, after the falling edge on LRCIN or LRCOUT
(see Figure 3-7).
LRCIN/
LRCOUT
BCLK
DIN/
DOUT
n
n1
0
1
n1
n
1/fs
Left Channel
Right Channel
1
0
MSB
LSB
1BCLK
Figure 37. I
2
S Mode Timing
3.3.1.4 DSP Mode
The DSP mode is compatible with the McBSP ports of TI DSPs. LRCIN and LRCOUT must be connected to the Frame
Sync signal of the McBSP. A falling edge on LRCIN or LRCOUT starts the data transfer. The left-channel data consists
of the first data word, which is immediately followed by the right channel data word (see Figure 3-8). Input word length
is defined by the IWL register. Figure 38 shows LRP = 1 (default LRP = 0).
LRCIN/
LRCOUT
BCLK
DIN/
DOUT
n
n1
0
1
n1
n
Left Channel
Right Channel
1
0
MSB
LSB
MSB
LSB
Figure 38. DSP Mode Timing
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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