參數(shù)資料
型號(hào)： TB2118FG
廠商： Toshiba Corporation
英文描述： High Speed PLL For DTS
中文描述： 高高速PLL為DTS
文件頁(yè)數(shù)： 10/20頁(yè)
文件大?。?/td> 348K
代理商： TB2118FG
TB2118FG
2006-04-12
10
3. Setting programmable counter block
1) Circuit configuration
The progammable counter block consists of a 2
modulus prescaler, 4
bit swallow counter, and 12
bit
programmable binary counter.
2) Setting input pin / dividing mode (AM / FM, mode)
AM / FM
Mode
Input Pin
Input Frequency
Divided Frequency
Dividing Mode
0
0
FM
VCO
30~150MHz
1
1
AM
VCO
1~40MHz
528~65.535
By pulse swallow
(16
bit)
3) Setting divided frequency (P
00
to P
15
)
By pulse swallow (in FW or SW mode), n = 528 to 65.535
X
PSC
15
16
2
modulus
prescaler
12
bit
(P
04
to P
15
)
programmable binary counter
4
bit (
P
00
to P
03
)
swallow counter
AM VCO
FM VCO
(AM)
(MODE, AM / PM)
(FM)
PRS
f
SIG
To phase
comparator
P
P
P
P
P
P
P
P
P
P
P
P
P
P
P
P
LSB
2
0
MSB
2
15
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PDF描述
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