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參數(shù)資料
| 型號： | TAS3001C |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | Stereo Audio Digital Equalizer |
| 中文描述： | 立體聲音頻數(shù)字均衡器 |
| 文件頁數(shù)： | 24/56頁 |
| 文件大?。?/td> | 417K |
| 代理商： | TAS3001C |
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34
3.2.5
I
2
C Serial Port Timing
PARAMETER
MIN
MAX
UNIT
f(scl)
tBUF
tw(low)
tw(high)
th(STA)
tsu(STA)
th(DAT)
tsu(DAT)
tr
tf
tsu(STO)
A device must internally provide a hold time of at least 300 ns for the SDA signal to bridge the undefined region of the falling edge of SCL.
NOTES:
1. tw(low) is measured from the end of tf to the beginning of tr.
2. tw(high) is measured from the end of tr to the beginning of tf.
SCL clock frequency
0
100
kHz
μ
s
μ
s
μ
s
μ
s
μ
s
μ
s
ns
Bus free time between start and stop
4.7
Pulse duration, SCL clock low (see Note 1)
4.7
Pulse duration, SCL clock high (see Note 2)
4
Hold time, repeated start
4
Setup time, repeated start
4.7
0
20
Hold time, data
Setup time, data
250
Rise time for SDA and SCL
1000
ns
Fall time for SDA and SCL
300
ns
μ
s
Setup time for stop condition
4
P
S
P
Valid
Data Line
Stable
Figure 34. I
2
C Serial Port Timing
Change of Data
Allowed
SDA
SCL
tBUF
th(STA)
tr
th(DAT)
tsu(DAT)
tf
tsu(STA)
th(STA)
tsu(STO)
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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