參數(shù)資料
型號(hào)： ST72P621L4B1
英文描述： LOW SPEED USB 8-BIT MCU WITH 3 ENDPOINTS. FLASH OR ROM MEMORY. LVD. WDG. 10-BIT ADC. 2 TIMERS. SCI. SPI
中文描述： 低速USB 8端點(diǎn)與3位微控制器。 FLASH或ROM存儲(chǔ)器。內(nèi)徑。水分散粒劑。 10位ADC。 2定時(shí)器。脊髓損傷。的SPI
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代理商： ST72P621L4B1
ST7262
104/133
12.5 CLOCK AND TIMING CHARACTERISTICS
Subject to general operating conditions for VDD, fCPU, and TA.
12.5.1 General Timings
1. Data based on typical application software.
2. Time measured between interrupt event and interrupt vector fetch.
t
c(INST) is the number of tCPU cycles needed to finish
the current instruction execution.
12.5.2 CONTROL TIMING CHARACTERISTICS
Note 1:
The minimum period tILIL should not be less than the number of cycle times it takes to execute the interrupt service routine
plus 21 cycles.
Note 2:
Not tested in production, guaranteed by design.
Symbol
Parameter
Conditions
Min
Typ 1)
Max
Unit
tc(INST)
Instruction cycle time
fCPU=8MHz
2
3
12
tCPU
250
375
1500
ns
tv(IT)
Interrupt reaction time 2)
tv(IT) = tc(INST) + 10 tCPU
fCPU=8MHz
10
22
tCPU
1.25
2.75
s
CONTROL TIMINGS
Symbol
Parameter
Conditions
Value
Unit
Min 2)
Typ. 2)
Max 2)
fOSC
Oscillator Frequency
12
MHz
fCPU
Operating Frequency
8
MHz
tRL
External RESET
Input pulse Width
1.5
tCPU
tPORL
Internal Power Reset Duration
514
tCPU
TRSTL
Reset Pin Output Pulse Width
10
s
tWDG
Watchdog Time-out
fcpu = 8MHz
65536
8.192
4194304
524.288
tCPU
ms
tOXOV
Crystal Oscillator
Start-up Time
20
30
40
ms
tDDR
Power up rise time
from VDD = 0 to 4V
100
ms
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