參數(shù)資料
型號： ST72F60E1M1
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDSO24
封裝： 0.300 INCH, LEAD FREE, PLASTIC, SOP-24
文件頁數(shù)： 120/139頁
文件大?。?/td> 1993K
代理商： ST72F60E1M1
ST7260xx
Serial communications interface (SCI)
81/139
Figure 40.
Bit sampling in reception mode
13.2.3
Low power modes
13.2.4
Interrupts
The SCI interrupt events are connected to the same interrupt vector.
These events generate an interrupt if the corresponding Enable Control bit is set and the
interrupt mask in the CC register is reset (RIM instruction).
RDI LINE
Sample
clock
12345678910
11 12
13
14
15
16
sampled values
One bit time
6/16
7/16
Table 36.
Effect of low power modes on SCI
Mode
Description
Wait
No effect on SCI.
SCI interrupts cause the device to exit from Wait mode.
Halt
SCI registers are frozen.
In Halt mode, the SCI stops transmitting/receiving until Halt mode is exited.
Table 37.
SCI interrupt control/wake-up capability
Interrupt event
Event flag Enable control bit Exit from Wait
Exit from Halt
Transmit data register empty
TDRE
TIE
Yes
No
Transmission complete
TC
TCIE
Yes
No
Received data ready to be read
RDRF
RIE
Yes
No
Overrun error detected
OR
Yes
No
Idle line detected
IDLE
ILIE
Yes
No
Parity error
PE
PIE
Yes
No
相關(guān)PDF資料
PDF描述
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ST72P60E2M1 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PDSO24
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參數(shù)描述
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