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參數(shù)資料
| 型號： | SPAKDSP311VL150 |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 87/96頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSP 24BIT 150MHZ 196-MAPBGA |
| 標(biāo)準(zhǔn)包裝： | 2 |
| 系列： | DSP56K/Symphony |
| 類型： | 定點(diǎn) |
| 接口： | 主機(jī)接口，SSI，SCI |
| 時鐘速率： | 150MHz |
| 非易失內(nèi)存： | ROM（576 B） |
| 芯片上RAM： | 384kB |
| 電壓 - 輸入/輸出： | 3.30V |
| 電壓 - 核心： | 1.80V |
| 工作溫度： | -40°C ~ 100°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 196-LBGA |
| 供應(yīng)商設(shè)備封裝： | 196-MAPBGA（15x15） |
| 包裝： | 托盤 |
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DSP56311 Technical Data, Rev. 8
A-12
Freescale Semiconductor
Power Consumption Benchmark
M_DRS EQU $F800
; DMA Request Source Mask (DRS0-DRS4)
M_DCON EQU 16
; DMA Continuous Mode
M_DPR EQU $60000
; DMA Channel Priority
M_DPR0 EQU 17
; DMA Channel Priority Level (low)
M_DPR1 EQU 18
; DMA Channel Priority Level (high)
M_DTM EQU $380000
; DMA Transfer Mode Mask (DTM2-DTM0)
M_DTM0 EQU 19
; DMA Transfer Mode 0
M_DTM1 EQU 20
; DMA Transfer Mode 1
M_DTM2 EQU 21
; DMA Transfer Mode 2
M_DIE EQU 22
; DMA Interrupt Enable bit
M_DE EQU 23
; DMA Channel Enable bit
;
DMA Status Register
M_DTD EQU $3F
; Channel Transfer Done Status MASK (DTD0-DTD5)
M_DTD0 EQU 0
; DMA Channel Transfer Done Status 0
M_DTD1 EQU 1
; DMA Channel Transfer Done Status 1
M_DTD2 EQU 2
; DMA Channel Transfer Done Status 2
M_DTD3 EQU 3
; DMA Channel Transfer Done Status 3
M_DTD4 EQU 4
; DMA Channel Transfer Done Status 4
M_DTD5 EQU 5
; DMA Channel Transfer Done Status 5
M_DACT EQU
8
; DMA Active State
M_DCH EQU
$E00
; DMA Active Channel Mask (DCH0-DCH2)
M_DCH0 EQU
9
; DMA Active Channel 0
M_DCH1 EQU
10
; DMA Active Channel 1
M_DCH2 EQU
11
; DMA Active Channel 2
;------------------------------------------------------------------------
;
EQUATES for Enhanced Filter Co-Processor (EFCOP)
;
;------------------------------------------------------------------------
M_FDIR
EQU
$FFFFB0
; EFCOP Data Input Register
M_FDOR
EQU
$FFFFB1
; EFCOP Data Output Register
M_FKIR
EQU
$FFFFB2
; EFCOP K-Constant Register
M_FCNT
EQU
$FFFFB3
; EFCOP Filter Counter
M_FCSR
EQU
$FFFFB4
; EFCOP Control Status Register
M_FACR
EQU
$FFFFB5
; EFCOP ALU Control Register
M_FDBA
EQU
$FFFFB6
; EFCOP Data Base Address
M_FCBA
EQU
$FFFFB7
; EFCOP Coefficient Base Address
M_FDCH
EQU
$FFFFB8
; EFCOP Decimation/Channel Register
;------------------------------------------------------------------------
;
EQUATES for Phase Locked Loop (PLL)
;
;------------------------------------------------------------------------
;
Register Addresses Of PLL
M_PCTL EQU $FFFFFD
; PLL Control Register
;
PLL Control Register
M_MF EQU $FFF
: Multiplication Factor Bits Mask (MF0-MF11)
M_DF EQU $7000
; Division Factor Bits Mask (DF0-DF2)
M_XTLR EQU 15
; XTAL Range select bit
M_XTLD EQU 16
; XTAL Disable Bit
M_PSTP EQU 17
; STOP Processing State Bit
M_PEN EQU 18
; PLL Enable Bit
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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