參數(shù)資料
型號(hào)： SME5410MCZ-270
元件分類： 微控制器/微處理器
英文描述： 64-BIT, 270 MHz, RISC PROCESSOR, XMA
封裝： 130 X 100 MM, 45 MM HEIGHT MODULE
文件頁數(shù)： 13/30頁
文件大?。?/td> 183K
代理商： SME5410MCZ-270
20
SME5410MCZ-270
270 MHz CPU, 256 Kbyte E-cache, UPA, 66 MHz PCI
UltraSPARC-IIi CPU Module
July 1998
Sun Microsystems, Inc
JTAG INTERFACE
The UltraSPARC-IIi CPU module (SME5410MCZ-270) implements the IEEE 1149.1 JTAG standard to aid in
board level testing. A Boundary Scan Description Language (BSDL) le is available for these devices.
JTAG Timing
Figure 7. Voltage Waveforms - Input Setup and Hold Times
Figure 8. Voltage Waveforms - Output Propagation Delay Times
AC Characteristics - JTAG Timing (estimated values)
Symbol
Parameter
Signals
Conditions
270 Mhz
Units
Min
Typ
Max
t
W (TRST)
Test reset pulse width
TRST [1]
1. TRST is an asynchronous reset.
5–
–
ns
t
SU (TDI)
Input setup time to TCK
TDI
–
3
–
ns
t
SU (TMS)
Input setup time to TCK
TMS
–
4
–
ns
t
H(TDI)
Input hold time to TCK
TDI
–
1.5
–
ns
t
H(TMS)
Input hold time to TCK
TMS
–
1.5
–
ns
t
PD(TDO)
Output delay from TCK [2]
2. TDO is referenced from falling edge of TCK.
TDO
I
OL = 8 mA
I
OH = -4 mA
C
L = 35 pF
V
LOAD = 1.5V
–6
–
ns
t
OH(TDO)
Output hold time from
TCK [2]
TDO
–
3
ns
Input
t
H
1.5V
V
IH
V
IL
TCK
t
SU
2.0V
V
IH
V
IL
1.5V
TCK
t
PD
TDO,
low-to-high
TDO,
high-to-low
2.0V
V
IH
V
IL
V
OH
V
OL
V
OH
V
OL
t
OH
t
PD
t
OH
0.8V
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