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參數(shù)資料
| 型號： | SI5375B-A-GL |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 32/54頁 |
| 文件大小： | 0K |
| 描述： | IC CLK GEN/JITTER ATTEN 80LBGA |
| 標準包裝： | 240 |
| 系列： | DSPLL® |
| 類型： | 時鐘發(fā)生器，漂移衰減器 |
| PLL： | 是 |
| 輸入： | 時鐘 |
| 輸出： | CML，CMOS，LVDS，LVPECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 4:4 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 808MHz |
| 除法器/乘法器： | 是/是 |
| 電源電壓： | 1.71 V ~ 2.75 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 80-LBGA |
| 供應(yīng)商設(shè)備封裝： | 80-BGA（10x10） |
| 包裝： | 托盤 |
| 其它名稱： | 336-2045 |
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Si5375
38
Rev. 1.0
Reset value = 0010 0000
Reset value = 0000 0110
Register 128.
Bit
D7D6D5D4D3D2
D1
D0
Name
OSC_ACTV_REG
CK_ACTV_REG
Type
RR
RRR
R
Bit
Name
Function
7:2
Reserved
1
OSC_ACTV_REG
OSC_ACTV_REG.
Indicates if OSC is currently the active clock for PLL input.
0
CK_ACTV_REG
CK_ACTV_REG.
Indicates if CKIN_q is currently the active clock for the PLL input.
0: CKIN_q is not the active input clock. Either it is not selected or LOS_INT is 1.
1: CKIN_q is the active input clock.
Register 129.
Bit
D7
D6D5
D4D3D2D1D0
Name
LOS_INT
LOSX_INT
Type
RRRRRRRR
Bit
Name
Function
7:2
Reserved
1LOS_INT
LOS_INT.
Indicates the LOS status on CKINn_q.
0: Normal operation.
1: Internal loss-of-signal alarm on CKINn_q input.
0
LOSX_INT
LOSX_INT.
Indicates the LOS status of the external reference on the OSC_P/N pins.
0: Normal operation.
1: Internal loss-of-signal alarm on OSC_P/N reference clock input.
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