DSPLL B CKIN1N_B ÷ N32 f
參數(shù)資料
型號： SI5375B-A-GL
廠商： Silicon Laboratories Inc
文件頁數(shù)： 12/54頁
文件大?。?/td> 0K
描述： IC CLK GEN/JITTER ATTEN 80LBGA
標(biāo)準(zhǔn)包裝： 240
系列： DSPLL®
類型： 時鐘發(fā)生器，漂移衰減器
PLL： 是
輸入： 時鐘
輸出： CML，CMOS，LVDS，LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 4:4
差分 - 輸入:輸出： 是/是
頻率 - 最大： 808MHz
除法器/乘法器： 是/是
電源電壓： 1.71 V ~ 2.75 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 80-LBGA
供應(yīng)商設(shè)備封裝： 80-BGA（10x10）
包裝： 托盤
其它名稱： 336-2045
Si5375
2
Rev. 1.0
Functional Block Diagram
CKIN1P_B
÷ N31
DSPLL
B
CKIN1N_B
÷ N32
fOSC
÷ NC1_HS
Input
Monitor
f3
÷ N2
Status / Control
PLL Bypass
High PSRR
Voltage Regulator
VDD_q
GND
Synthesis Stage
CKIN1P_A
CKOUT1N_A
÷ N31
DSPLL
A
CKIN1N_A
÷ N32
CKOUT1P_A
Output Stage
fOSC
÷ NC1_HS
Input
Monitor
f3
÷ N2
PLL Bypass
Input Stage
CKIN1P_D
÷ N31
DSPLL
D
CKIN1N_D
÷ N32
fOSC
÷ NC1_HS
Input
Monitor
f3
÷ N2
PLL Bypass
CKIN1P_C
÷ N31
DSPLL
C
CKIN1N_C
÷ N32
fOSC
÷ NC1_HS
Input
Monitor
f3
÷ N2
PLL Bypass
RSTL_q
CS_q
SCL
SDA LOL_q IRQ_q
Low Jitter
XO or Clock
OSC_P/N
÷ NC1
PLL Bypass
CKOUT1N_B
÷ NC1
PLL Bypass
CKOUT1P_B
CKOUT1N_C
PLL Bypass
CKOUT1P_C
÷ NC1
CKOUT1N_D
÷ NC1
PLL Bypass
CKOUT1P_D
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PDF描述
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