SCF5250 Data Sheet: Technical Data, Rev. 1.3 Freescale Se" />
參數(shù)資料
型號： SCF5250VM120
廠商： Freescale Semiconductor
文件頁數(shù)： 29/56頁
文件大?。?/td> 0K
描述： MCU 32BIT 120MHZ AUD 196-MAPBGA
產(chǎn)品變化通告： Product Discontinuation 24/Feb/2012
標(biāo)準(zhǔn)包裝： 126
系列： SCF52xx
核心處理器： Coldfire V2
芯體尺寸： 32-位
速度： 120MHz
連通性： EBI/EMI，I²C，IDE，MMC，SPI，UART/USART
外圍設(shè)備： DMA，I²S，POR，串行音頻，WDT
輸入/輸出數(shù)： 57
程序存儲器類型： ROMless
RAM 容量： 128K x 8
電壓 - 電源 (Vcc/Vdd)： 1.08 V ~ 1.32 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 6x12b
振蕩器型： 內(nèi)部
工作溫度： -20°C ~ 70°C
封裝/外殼： 196-LBGA
包裝： 托盤
SCF5250 Data Sheet: Technical Data, Rev. 1.3
Freescale Semiconductor
35
Figure 12 provides the SCLK input, SDATA output timing diagram for the IIS module and Table 31
provides the timing parameters.
Figure 12. SCLK Input, SDATA Output Timing Diagram
Figure 13 provides the SCLK output, SDATA output timing diagram for the IIS module and Table 32
provides the timing parameters.
Figure 13. SCLK Output, SDATA Output Timing Diagram
J11
TCK falling to Boundary Scan Data Valid (signal from driven or three-state)
–
tbd
ns
J12
TCK falling to Boundary Scan. Data High Impedance
–
tbd
ns
Table 31. SCLK Input, SDATA Output Timing Specifications
Num
Characteristic
Min
Max
Units
TU
SCLK fall to SDATAO rise
–
25
ns
TD
SCLK fall to SDATAO fall
–
25
ns
Table 32. SCLK Output, SDATA Output Timing Specifications
Num
Characteristic
Min
Max
Units
TU
SCLK fall to SDATAO rise
–
3
ns
TD
SCLK fall to SDATAO fall
–
3
ns
Table 30. JTAG AC Timing Specifications (continued)
Num
Characteristic
Min
Max
Units
SCLK
(INPUT)
SDATAO1, 2 (OUTPUT)
TU
TD
SCLK
(OUTPUT)
SDATAO1, 2 (OUTPUT)
TU
TD
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PDF描述
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