SCF5250 Data Sheet: Technical Data, Rev. 1.3 Freescale Se" />
參數(shù)資料
型號: SCF5250VM120
廠商: Freescale Semiconductor
文件頁數(shù): 20/56頁
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描述: MCU 32BIT 120MHZ AUD 196-MAPBGA
產(chǎn)品變化通告: Product Discontinuation 24/Feb/2012
標準包裝: 126
系列: SCF52xx
核心處理器: Coldfire V2
芯體尺寸: 32-位
速度: 120MHz
連通性: EBI/EMI,I²C,IDE,MMC,SPI,UART/USART
外圍設(shè)備: DMA,I²S,POR,串行音頻,WDT
輸入/輸出數(shù): 57
程序存儲器類型: ROMless
RAM 容量: 128K x 8
電壓 - 電源 (Vcc/Vdd): 1.08 V ~ 1.32 V
數(shù)據(jù)轉(zhuǎn)換器: A/D 6x12b
振蕩器型: 內(nèi)部
工作溫度: -20°C ~ 70°C
封裝/外殼: 196-LBGA
包裝: 托盤
SCF5250 Data Sheet: Technical Data, Rev. 1.3
Freescale Semiconductor
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Figure 4. Input/Output AC Timing Definition-III
Table 21. Input AC Timing Specification
Num
Characteristic
Min
Max
Units
B11,2
1 Inputs (rising): DATA[31:16]
2 AC timing specs assume 40pF load capacitance on BCLK and 50pF load capacitance on output pins. If this value is different,
the input and output timing specifications would need to be adjusted to match the clock load.
Signal Valid to BCLK Rising (setup)
3
ns
BCLK Rising to signal Invalid (hold)
2
ns
BCLK to Input High Impedance
5
BCLK cycle
Table 22. Output AC Timing Specification
Num
Characteristic1
Min
Max
Units
B102
BCLK (8mA) Rising to signal Valid
10
ns
BCLK (8mA) Rising to signal Invalid (hold)
3.5
ns
B103
BCLK (4mA) Rising to signal Valid
11
ns
BCLK (4mA) Rising to signal Invalid (hold)
4
ns
B124
BCLK to High Impedance (Three-State)
14
ns
B13
B14
BCLK
H1
H2
HIZ
OUTPUTS
BCLK
B3
B4
INPUTS
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