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參數(shù)資料
| 型號： | SAF-TC11IB-64D96EBC |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 96 MHz, RISC MICROCONTROLLER, PBGA388 |
| 封裝： | PLASTIC, BGA-388 |
| 文件頁數(shù)： | 105/110頁 |
| 文件大?。?/td> | 1303K |
| 代理商： | SAF-TC11IB-64D96EBC |
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TC11IB
Data Sheet
90
V2.4, 2004-06
Timing for Ethernet Signals
(Operating Conditions apply; CL = 50 pF)
Note: Any other parameters which are not stated here, please refer to ANSI/IEEE Std 802.3, Section 22.3.
Parameter
Symbol
Limits
Unit
min
max
ETXCLK period (10 Mbps Ethernet)
t1
SR 400.0
-
ns
ETXCLK high time (10 Mbps Ethernet)
t2
SR 140.0
260.0
ns
ETXCLK low time (10 Mbps Ethernet)
t3
SR 140.0
260.0
ns
ETXCLK period (100 Mbps Ethernet)
t1
SR 40.0
-
ns
ETXCLK high time (100 Mbps Ethernet)
t2
SR 14.0
26.0
ns
ETXCLK low time (100 Mbps Ethernet)
t3
SR 14.0
26.0
ns
ERXCLK period (10 Mbps Ethernet)
t1
SR 400.0
-
ns
ERXCLK high time (10 Mbps Ethernet)
t2
SR 140.0
260.0
ns
ERXCLK low time (10 Mbps Ethernet)
t3
SR 140.0
260.0
ns
ERXCLK period (100 Mbps Ethernet)
t1
SR 40.0
-
ns
ERXCLK high time (100 Mbps Ethernet)
t2
SR 14.0
26.0
ns
ERXCLK low time (100 Mbps Ethernet)
t3
SR 14.0
26.0
ns
ERXD(3:0) input setup to ERXCLK
t4
SR 10.0
-
ns
ERXD(3:0) input hold from ERXCLK
t5
SR -
10.0
ns
ERXDV input setup to ERXCLK
t4
SR 10.0
-
ns
ERXDV input hold from ERXCLK
t5
SR -
10.0
ns
ERXER input setup to ERXCLK
t4
SR 10.0
-
ns
ERXER input hold from ERXCLK
t5
SR -
10.0
ns
ETXD(3:0) output valid from ETXCLK
t6
CC -
25.0
ns
ETXEN output valid from ETXCLK
t6
CC -
25.0
ns
ETXER output valid from ETXCLK
t6
CC -
25.0
ns
EMDC clock period
t7
CC 150.0
-
ns
EMDIO input setup to EMDC (sourced by STA)
t8
SR 10.0
-
ns
EMDIO input hold from EMDC (sourced by STA)
t9
SR -
10.0
ns
EMDIO output valid from EMDC (sourced by PHY)
t10 CC -
300.0
ns
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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