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參數(shù)資料
| 型號： | SAF-TC1130-L150EBGREEN |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, FLASH, 150 MHz, MICROCONTROLLER, PBGA208 |
| 封裝： | GREEN, PLASTIC, LBGA-208 |
| 文件頁數(shù)： | 48/117頁 |
| 文件大?。?/td> | 1726K |
| 代理商： | SAF-TC1130-L150EBGREEN |
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TC1130
Functional Description
Data Sheet
30
V1.0, 2005-02
Advance Information
Features:
The FPI Bus is designed with the requirements of high-performance systems in mind.
The features are:
Core independent
Multimaster capability (up to 16 masters)
Demultiplexed operation
Clock synchronous
Peak transfer rate of up to 800 Mbytes/sec (@ 100 MHz bus clock)
Address and data bus scalable (address bus up to 32 bits, data bus up to 64 bits)
8-/16-/32- and 64-bit data transfers
Broad range of transfer types from single to multiple data transfers
Split transaction support for agents with long response time
Burst transfer capability
EMI and power consumption minimized
3.4.3
LFI
The LMB-to-FPI Interface (LFI) block provides the circuitry to interface (bridge) the FPI
bus and the Local Memory Bus (LMB).
LFI Features:
Full support for bus transactions found within current TriCore 1.3 based systems:
– Single 8/16/32-bit Write/Read transfers from FPI to LMB
– Single 8/16/32/64-bit Write/Read transfers from LMB to FPI
– Read-Modify-Write transfers of 8/16/32-bit in both directions
– Burst transactions of 2, 4 or 8 data beats from the FPI to the LMB
– Burst transactions of 2 or 4 data beats from the LMB to the FPI
Address decoding and translation as required by TriCore 1.3 implementation
FPI master interface supports full pipelining on FPI bus
LMB master interface supports pipelining on LMB within the scope of the LMB
specification
FPI master interface can act as default master on FPI bus
Programmable support for split LMB to FPI read transactions
Retry generation on both FPI and LMB buses
Full support for abort, retry, error and FPI timeout conditions
Flexible LMB/FPI clock ratio support including dynamic clock switching support
LFI core clock may be shut down when no transactions are being issued to LFI from
either bus and the LFI has no transactions in progress, thus saving power.
相關(guān)PDF資料 |
PDF描述 |
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| SAF-XC161CJ-16F40F | 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP144 |
| SAK-XC161CJ-16F20F | 16-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQFP144 |
| SAF-XC164CM-8F40F | 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP64 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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