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參數(shù)資料
| 型號(hào)： | S3P8245XX-TW |
| 元件分類(lèi)： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, OTPROM, 10 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | 12 X 12 MM, TQFP-80 |
| 文件頁(yè)數(shù)： | 210/217頁(yè) |
| 文件大?。?/td> | 1237K |
| 代理商： | S3P8245XX-TW |
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S3C8248/C8245/P8245/C8247/C8249/P8249
INTERRUPT STRUCTURE
5-5
Table 5-1. Interrupt Vectors
Vector Address
Interrupt Source
Request
Reset/Clear
Decimal
Value
Hex
Value
Interrupt
Level
Priority in
Level
H/W
S/W
256
100H
Basic timer overflow
RESET
–
√
226
E2H
Timer A overflow
IRQ0
1
√
224
E0H
Timer A match/capture
0
√
228
E4H
Timer B match
IRQ1
–
√
230
E6H
Timer 0 match
IRQ2
–
√
234
EAH
Timer 1 overflow
IRQ3
1
√
232
E8H
Timer 1 match/capture
0
√
236
ECH
SIO interrupt
IRQ4
–
√
238
EEH
Watch timer overflow
IRQ5
–
√
246
F6H
P0.3 external interrupt
IRQ6
3
√
244
F4H
P0.2 external interrupt
2
√
242
F2H
P0.1 external interrupt
1
√
240
F0H
P0.0 external interrupt
0
√
254
FEH
P0.7 external interrupt
IRQ7
3
√
252
FCH
P0.6 external interrupt
2
√
250
FAH
P0.5 external interrupt
1
√
248
F8H
P0.4 external interrupt
0
√
NOTES:
1.
Interrupt priorities are identified in inverse order: "0" is the highest priority, "1" is the next highest, and so on.
2.
If two or more interrupts within the same level contend, the interrupt with the lowest vector address usually has priority
over one with a higher vector address. The priorities within a given level are fixed in hardware.
相關(guān)PDF資料 |
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