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參數(shù)資料
| 型號(hào)： | S3C821AXX-QW |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | 14 X 20 MM, QFP-80 |
| 文件頁數(shù)： | 78/208頁 |
| 文件大?。?/td> | 1310K |
| 代理商： | S3C821AXX-QW |
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SERIAL I/O INTERFACE
S3C821A/P821A
15-2
SIO CONTROL REGISTER (SIOCON)
The control register for serial I/O interface module, SIOCON, is located at F5H in set 1, bank 0. It has the control
settings for SIO module.
— Clock source selection (internal or external) for shift clock
— Interrupt enable
— Edge selection for shift operation
— Clear 3-bit counter and start shift operation
— Shift operation (transmit) enable
— Mode selection (transmit/receive or receive-only)
— Data direction selection (MSB first or LSB first)
A reset sets the SIOCON value to "80H". This configures the corresponding module with a CPU clock source at
the SCK, selects receive-only operating mode, and falling edge start. The data shift operation and the interrupt
are disabled. The selected data direction is MSB-first.
MSB
LSB
.7
.6
.5
.4
.3
.2
.1
.0
SIO CONTROL REGISTER (SIOCON)
F5H, Set 1, Bank 0, R/W
SIO shift clock selection:
0 = External clock
1 = CPU clock
SIO counter clear and shifter start bit:
0 = No action (when write)
1 = Clear 3-bit counter and start shifting
SIO mode selection bit:
0 = Receive-only mode
1 = Transmit/receive mode
SIO interrupt pending bit:
0 = No interrupt pending
0 = Clear pending condition
(when write)
1 = Interrupt is pending
Data direction control bit:
0 = MSB-first mode
1 = LSB-first mode
SIO interrupt enable bit:
0 = Disable interrupt
1 = Enable interrupt
SIO start edge selection bit:
0 = Falling edge start
1 = Rising edge start
SIO shift operation enable bit:
0 = Disable shifter and counter, retain IRQ status
1 = Enable shifter and clock counter,
set IRQ flag to “1”
Figure 15-1. Serial I/O Port Control Register (SIOCON)
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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