參數(shù)資料
型號: S3C821AXX-QW
元件分類: 微控制器/微處理器
英文描述: 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP80
封裝: 14 X 20 MM, QFP-80
文件頁數(shù): 18/208頁
文件大小: 1310K
代理商: S3C821AXX-QW
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RESET
RESET and POWER-DOWN
S3C821A/P821A
8-6
IDLE MODE
Idle mode is invoked by the instruction IDLE. In Idle mode, CPU operations are halted while some peripherals
remain active. During Idle mode, the internal clock signal is gated away from the CPU and from all but the
following peripherals, which remain active:
— Interrupt logic
— Basic timer
— Timer 0
— Timer 1 (Timer A and B)
— Watch timer
— LCD controller
— A/D converter
I/O port pins retain the mode (input or output) they had at the time Idle mode was entered. External interface pins
are halted by high or low level, in the idle mode.
Idle Mode Release
You can release Idle mode in one of two ways:
1.
Execute a reset. All system and peripheral control registers are reset to their default values and the contents
of all data registers are retained. The reset automatically selects the slowest clock (1/16) because of the
hardware reset value for the CLKCON register. If all external interrupts are masked in the IMR register, a
reset is the only way you can release Idle mode.
2.
Activate any enabled interrupt — internal or external. When you use an interrupt to release Idle mode, the
2-bit CLKCON.4/CLKCON.3 value remains unchanged, and the currently selected clock value is used. The
interrupt is then serviced. When the return-from-interrupt condition (IRET) occurs, the instruction
immediately following the one which initiated Idle mode is executed.
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PDF描述
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