參數(shù)資料
型號: S3C821AXX-QW
元件分類: 微控制器/微處理器
英文描述: 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP80
封裝: 14 X 20 MM, QFP-80
文件頁數(shù): 203/208頁
文件大小: 1310K
代理商: S3C821AXX-QW
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INTERRUPT STRUCTURE
S3C821A/P821A
5-10
SYSTEM MODE REGISTER (SYM)
The system mode register, SYM (set 1, DEH), is used to globally enable and disable interrupt processing and to
control fast interrupt processing (see Figure 5-5).
A reset clears SYM.7, SYM.1, and SYM.0 to "0". The 3-bit value for fast interrupt level selection, SYM.4-SYM.2,
is undetermined.
The instructions EI and DI enable and disable global interrupt processing, respectively, by modifying the bit 0
value of the SYM register. In order to enable interrupt processing, an Enable Interrupt (EI) instruction must be
included in the initialization routine, which follows a reset operation. Although you can manipulate SYM.0 directly
to enable and disable interrupts during the normal operation, it is recommended to use the EI and DI instructions
for this purpose.
SYSTEM MODE REGISTER (SYM)
DEH, Set 1, R/W
MSB
LSB
.7
.6
.5
.4
.3
.2
.1
.0
External interface tri-state enable bit:
0= Normal operation (Tri-state disabled)
1= Set external interface lines to high
impedance (Tri-state enabled)
Not used for the S3C821A
Fast interrupt level selection bits:
Global interrupt enable bit:
0 = Disable all interrupts processing
1 = Enable all interrupts processing
0 0 0
0 0 1
0 1 0
0 1 1
1 0 0
1 0 1
1 1 0
1 1 1
IRQ0
IRQ1
IRQ2
Not used
IRQ4
IRQ5
IRQ6
IRQ7
Fast interrupt enable bit:
0 = Disable fast interrupts processing
1 = Enable fast interrupts processing
Figure 5-5. System Mode Register (SYM)
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PDF描述
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