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參數(shù)資料
| 型號： | S1C7XXXF00E199 |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, 90 MHz, RISC MICROCONTROLLER, PQFP |
| 文件頁數(shù)： | 49/196頁 |
| 文件大?。?/td> | 1650K |
| 代理商： | S1C7XXXF00E199 |
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7 DETAILS OF INSTRUCTIONS
7-78
EPSON
S1C17 FAMILY S1C17 CORE MANUAL
(2) Extension 1
ext
imm13
ld.b
%rd,[%rb]
; memory address = rb + imm13
The ext instruction changes the addressing mode to register indirect addressing with
displacement. As a result, the content of the rb register with the 13-bit immediate imm13 added
comprises the memory address, the byte data in which is transferred to the rd register after being
sign-extended to 16 bits. The eight high-order bits of the rd register are set to 0. The content of
the rb register is not altered.
(3) Extension 2
ext
imm13
; imm13(10:0) = imm24(23:13)
ext
imm13
; = imm24(12:0)
ld.b
%rd,[%rb]
; memory address = rb + imm24
The addressing mode changes to register indirect addressing with displacement, so the content
of the rb register with the 24-bit immediate imm24 added comprises the memory address, the
byte data in which is transferred to the rd register after being sign-extended to 16 bits. The eight
high-order bits of the rd register are set to 0. The content of the rb register is not altered.
(4) Address increment/decrement option
Specifying the []+, []-, or -[] option will automatically increment/decrement the memory
address. This allows the program to simply perform continuous data transfer.
ld.b
%rd,[%rb]+
Load instruction with post-increment option
The memory address will be incremented after the data transfer has
finished.
ld.b
%rd,[%rb]-
Load instruction with post-decrement option
The memory address will be decremented after the data transfer has
finished.
ld.b
%rd,-[%rb]
Load instruction with pre-decrement option
The memory address will be decremented before starting the data
transfer.
The address increment/decrement sizes are listed below.
When no ext is used (as in (1) shown above):
1 (byte size)
When one ext is used (as in (2) shown above): imm13
When two ext are used (as in (3) shown above): imm24
(5) Delayed slot instruction
This instruction may be executed as a delayed slot instruction by writing it directly after
a branch instruction with the “d” bit. In this case, extension of the immediate by the ext
instruction cannot be performed.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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