參數(shù)資料
型號： PSD854F2V-15M
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： 256K X 8 FLASH, 27 I/O, PIA-GENERAL PURPOSE, PQFP52
封裝： PLASTIC, QFP-52
文件頁數(shù)： 87/109頁
文件大?。?/td> 908K
代理商： PSD854F2V-15M
Obsolete
Product(s)
- Obsolete
Product(s)
79/109
PSD813F2V, PSD854F2V
Doc ID 10552 Rev 3
Note: 1. Reset (RESET) has hysteresis. VIL1 is valid at or below 0.2VCC –0.1. VIH1 is valid at or above 0.8VCC.
2. CSI deselected or internal PD is active.
3. PLD is in non-Turbo mode, and none of the inputs are switching.
4. Please see Figure 36., page 72 for the PLD current calculation.
5. IOUT = 0mA
Figure 40. Input to Output Disable / Enable
VHYS
Reset Pin Hysteresis
0.3
V
VLKO
VCC (min) for Flash Erase and
Program
1.5
2.2
V
VOL
Output Low Voltage
IOL = 20A, VCC = 3.0 V
0.01
0.1
V
IOL = 4mA, VCC = 3.0 V
0.15
0.45
V
VOH
Output High Voltage
IOH = –20A, VCC = 3.0 V
2.9
2.99
V
IOH = –1mA, VCC = 3.0 V
2.7
2.8
V
ILI
Input Leakage Current
VSS < VIN < VCC
–1
±0.1
1
A
ILO
Output Leakage Current
0.45 < VIN < VCC
–10
±5
10
A
ICC (DC)
(Note 5)
Operating
Supply
Current
PLD Only
PLD_TURBO = Off,
f = 0 MHz (Note 3)
0
A/PT
PLD_TURBO = On,
f = 0 MHz
200
400
A/PT
Flash memory
During Flash memory
WRITE/Erase Only
10
25
mA
Read only, f = 0 MHz
0
mA
SRAM
f = 0 MHz
0
mA
ICC (AC)
(Note 5)
PLD AC Adder
note 4
Flash memory AC Adder
1.5
2.0
mA/
MHz
SRAM AC Adder
0.8
1.5
mA/
MHz
Symbol
Parameter
Conditions
Min.
Typ.
Max.
Unit
tER
tEA
INPUT
INPUT TO
OUTPUT
ENABLE/DISABLE
AI02863
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