參數(shù)資料
型號(hào)： PNX1302
廠商： NXP Semiconductors N.V.
英文描述： Media Processors
中文描述： 媒體處理器
文件頁數(shù)： 246/548頁
文件大?。?/td> 6050K
代理商： PNX1302
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PNX1300/01/02/11 Data Book
Philips Semiconductors
15-8
PRELIMINARY SPECIFICATION
15.9.4
VLD Picture Info (VLD_PI)
This 32-bit register contains the picture layer information
necessary for the VLD to parse the macroblocks within
that picture. Again, the values for each of these fields are
determined by the appropriate standard (MPEG [1-3]).
15.10 ERROR HANDLING
Upon encountering a bitstream error, the VLD will set the
bitstream-error flag (ERROR) in the VLD_STATUS reg-
ister and interrupt the DSPCPU, if the interrupt is en-
abled. Note that if a start code is present (in the VLD shift
register) when an error is detected, then both the start
code and the error bits will be set. A separate flush com-
mand is required to flush any valid data in the run-level
and macroblock header output buffers.
The DSPCPU de-asserts the ERROR flags by writing a
‘
1
’
to the ERROR flag.
15.11 INTERRUPT
The interrupt source number for the VLD is 14 and it
should be set in level sensitive mode (see
Section
3.5.3.6 on pag e3-11
).
15.12 RESET
The VLD block is reset by a hardware reset or a software
reset. The hardware reset signal is generated from the
external pin TRI_RESET#. The software reset is initiated
by
writing
a
‘
Reset
VLD
’
VLD_COMMAND register. Refer
Table 15-8
for the de-
tails on the software reset procedure.
command
in
the
15.13 ENDIAN-NESS
VLD supports little-endian and big-endian modes of op-
erations. Refer to
Appendix C
for the endian-ness spec-
ification of the VLD input and output data.
15.14 POWER DOWN
The VLD block can be separately powered down by set-
ting a bit in the BLOCK_POWER_DOWN register. For a
description of powerdown, see
Chapter 21,
“
Power Man-
agement.
”
The VLD block should not be active when applying block
powerdown.
If the block enters power-down state while it is enabled,
its behavior upon power-up is undefined.
15.15 REFERENCES
[1] ISO/IEC IS 13818-2, International Standard (1994),
MPEG-2 Video.
[2] ISO/IEC IS 11172-2, International Standard (1992),
MPEG-1 Video.
[3] MPEG Video Compression Standard, by Joan L.
Mitchell, William B. Pennebaker, Chad E. Fogg, Didier J.
LeGall; ITP publication.
Table 15-7. VLD picture info register (r/w)
Name
Size
(bits)
Description
PICT_TYPE (picture
type)
PICT_STRUC (picture
structure)
FPFD (frame predic-
tion frame dct)
2
I, P or B picture
2
field or frame picture
1
specifies that this picture
uses only frame prediction
and frame dct
Use DCT table zero or one
concealment vectors present
in the bitstream
Reserved for future expan-
sion
Switches VLD between
MPEG-1 and MPEG-2
decoding.
Value
‘
1
’
= MPEG-2 mode
reserved
size of residual motion vector
INTRA_VLC
CONCEAL_MV
1
1
reserved
6
MPEG2 mode
1
reserved
HFRS (horizontal for-
ward rsize)
VFRS (vertical forward
rsize)
HBRS (horizontal
backward rsize)
VBRS (vertical back-
ward rsize)
2
4
4
size of residual motion vector
4
size of residual motion vector
4
size of residual motion vector
Table 15-8. Software reset procedure
Cycle
no.
Action
Remarks
i
DSPCPU issues the
‘
Reset
the VLD
’
command by writ-
ing the required value in the
VLD_COMMAND register.
VLD will complete the pend-
ing, if any, highway transac-
tions.
i to j
Any highway transac-
tions, once started, will
not be aborted in the
middle
All status and control
registers are reset and
all the buffers are
made empty.
MMIO Registers initial-
ized to zero includes
VLD_STATUS.
j+1
VLD will perform the full
reset.
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PNX1302EH/G,557 功能描述:數(shù)字信號(hào)處理器和控制器 - DSP, DSC NEXPERIA MEDIA PROC 200MHZ RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
PNX1311 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:Media Processors
PNX1311EH,557 功能描述:視頻 IC NEXPERIA MEDIA PROCESSOR RoHS:否 制造商:Fairchild Semiconductor 工作電源電壓:5 V 電源電流:80 mA 最大工作溫度:+ 85 C 封裝 / 箱體:TSSOP-28 封裝:Reel
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