參數(shù)資料
型號： PNX1302
廠商： NXP Semiconductors N.V.
英文描述： Media Processors
中文描述： 媒體處理器
文件頁數(shù)： 171/548頁
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代理商： PNX1302
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Philips Semiconductors
PCI Interface
PRELIMINARY SPECIFICATION
11-7
11.5.7
Cache Line Size Register
This field only matters when the MWI bit in confi guration
space is set. The value of the Cache Line Size register
specifies the host system cache line size in units of 32-
bit words. Initiating devices, such as the PNX1300, that
can generate memory-write-and-invalidate commands
must implement this register. When implemented, the
cache line size allows initiators participating in the PCI
caching protocol to retry burst accesses at cache-line
boundaries.
This register is implemented in PNX1300. In the
PNX1300, PCI DMA performs write-and-invalidate cy-
cles as per the table below. ICP DMA and CPU PCI
writes are performed using normal memory-write cycles.
11.5.8
Latency Timer Register
The value of the Latency Timer register specifies the
minimum number of PCI clock cycles the PNX1300 BIU
(as initiator) is allowed to own the PCI bus. This register
is readable and writable in PCI configuration space.
This register must be writable in any PCI-initiating device
that can burst more than two data phases. In the
PNX1300 PCI interface, the least-significant three bits
are hardwired to
’
0
’
and software can program any value
into the most-significant five bits. This permits software
to specify the time slice with a minimum granularity of
eight PCI clocks. A value of
’
0
’
signifies maximum laten-
cy, i.e. 256 PCI clocks.
11.5.9
Header Type Register
The value of the Header Type register defines the format
of words 16 through 63 in configuration space and
whether or not the device contains multiple functions.
Figure 11-6
shows the format of Header Type.
Bit 7 of Header Type is
’
0
’
for single-function devices,
’
1
’
for multi-function devices. PNX1300 is a single-function
device, so bit 7 is
’
0
’
.
Table 11-9
shows the encodings of
the Layout field.
11.5.10 Built-In Self Test Register
When implemented, the BIST register is used to control
the operation of a device
’
s built-in self testing capability.
PNX1300 does not implement BIST, so this register is
hardwired to return
’
0
’
s when read.
11.5.11 Base Address Registers
The PNX1300 PCI interface implements two configura-
tion
space
memory
Base
DRAM_BASE and MMIO_BASE. DRAM_BASE relo-
cates PNX1300
’
s SDRAM within the system address
space; MMIO_BASE relocates the 2-MB memory-
mapped I/O address aperture.
The values in the Base Address registers determine the
address map as seen by both the DSPCPU and external
PCI masters. These values are normally set once, and
not changed dynamically once the DSPCPU operates.
Address
registers:
Table 11-6. Base Class Encodings
Base Class
(in hex)
Meaning
00
Device was built before class code definitions
were finalized
Mass-storage controller
Network controller
Display controller
Multimedia device
Memory controller
Bridge device
Simple communications controller
Base system peripheral
Docking station
Processor
Serial bus controller
Reserved
Device does not fit any of the above classes
01
02
03
04
05
06
07
08
0A
0B
0C
0D
–
FE
FF
Table 11-7. Subclass & programming interface fields
Subclass
(in hex)
Programming
Interface (in hex)
Meaning
00
01
80
00
00
00
Video device
Audio device
Other multimedia device
Table 11-8. Cache line size values
Cache Line Size
(binary)
Effect
0000,0100
write-and-invalidates are done in 4-
DWORD, i.e. 16-byte chunks
write-and-invalidate in 8-DWORD chunks
write-and-invalidate in 16-DWORD chunks
only normal
‘
memory-write
’
is performed
0000,1000
0001,0000
all other values
Table 11-9. Layout encodings
Layout (in hex)
Meaning
00
01
Non-bridge PCI device
PCI-to-PCI bridge device
7
Header Type
0
Layout
6
MF
Figure 11-6. Header type register format.
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PDF描述
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參數(shù)描述
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PNX1302EH,557 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC MEDIA PROCESSOR PNX13XX/200MHZ RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
PNX1302EH/G,557 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC NEXPERIA MEDIA PROC 200MHZ RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
PNX1311 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:Media Processors
PNX1311EH,557 功能描述:視頻 IC NEXPERIA MEDIA PROCESSOR RoHS:否 制造商:Fairchild Semiconductor 工作電源電壓:5 V 電源電流:80 mA 最大工作溫度:+ 85 C 封裝 / 箱體:TSSOP-28 封裝:Reel
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