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參數(shù)資料
| 型號： | PIC18F45J50-I/ML |
| 廠商： | Microchip Technology |
| 文件頁數(shù)： | 11/164頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC PIC MCU FLASH 32K 2V 44-QFN |
| 產(chǎn)品培訓模塊： | XLP Deep Sleep Mode PIC18 J Series MCU Overview 8-bit PIC® Microcontroller Portfolio |
| 標準包裝： | 45 |
| 系列： | PIC® XLP™ 18F |
| 核心處理器： | PIC |
| 芯體尺寸： | 8-位 |
| 速度： | 48MHz |
| 連通性： | I²C，SPI，UART/USART，USB |
| 外圍設備： | 欠壓檢測/復位，DMA，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 34 |
| 程序存儲器容量： | 32KB（16K x 16） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 3.8K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.15 V ~ 3.6 V |
| 數(shù)據(jù)轉換器： | A/D 13x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 44-VQFN 裸露焊盤 |
| 包裝： | 管件 |
| 產(chǎn)品目錄頁面： | 657 (CN2011-ZH PDF) |
| 配用： | AC164322-ND - MODULE SOCKET MPLAB PM3 28/44QFN |
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PIC18F46J50 FAMILY
DS39931D-page 108
2011 Microchip Technology Inc.
7.4
Erasing Flash Program Memory
The minimum erase block is 512 words or 1024 bytes.
Only through the use of an external programmer, or
through ICSP control, can larger blocks of program
memory be bulk erased. Word erase in the Flash array
is not supported.
When initiating an erase sequence from the micro-
controller itself, a block of 1024 bytes of program
memory is erased. The Most Significant 12 bits of the
TBLPTR<21:10> point to the block being erased;
TBLPTR<9:0> are ignored.
The EECON1 register commands the erase operation.
The WREN bit must be set to enable write operations.
The FREE bit is set to select an erase operation. For
protection, the write initiate sequence for EECON2
must be used.
A long write is necessary for erasing the internal Flash.
Instruction execution is halted while in a long write
cycle. The long write will be terminated by the internal
programming timer.
7.4.1
FLASH PROGRAM MEMORY
ERASE SEQUENCE
The sequence of events for erasing a block of internal
program memory location is:
1.
Load Table Pointer register with the address of
the row being erased.
2.
Set the WREN and FREE bits (EECON1<2,4>)
to enable the erase operation.
3.
Disable interrupts.
4.
Write 0x55 to EECON2.
5.
Write 0xAA to EECON2.
6.
Set the WR bit; this will begin the erase cycle.
7.
The CPU will stall for the duration of the erase
for TIE (see Parameter D133B).
8.
Re-enable interrupts.
EXAMPLE 7-2:
ERASING FLASH PROGRAM MEMORY
MOVLW
CODE_ADDR_UPPER
; load TBLPTR with the base
MOVWF
TBLPTRU
; address of the memory block
MOVLW
CODE_ADDR_HIGH
MOVWF
TBLPTRH
MOVLW
CODE_ADDR_LOW
MOVWF
TBLPTRL
ERASE_ROW
BSF
EECON1, WREN
; enable write to memory
BSF
EECON1, FREE
; enable Erase operation
BCF
INTCON, GIE
; disable interrupts
Required
MOVLW
0x55
Sequence
MOVWF
EECON2
; write 0x55
MOVLW
0xAA
MOVWF
EECON2
; write 0xAA
BSF
EECON1, WR
; start erase (CPU stall)
BSF
INTCON, GIE
; re-enable interrupts
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PDF描述 |
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參數(shù)描述 |
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