參數(shù)資料
型號(hào)： PCF26100ET
廠商： NXP SEMICONDUCTORS
元件分類： 通信及網(wǎng)絡(luò)
英文描述： DVI_D - DVI_D SINGLE LINK CABLE 5M BLK RoHS Compliant: Yes
中文描述： SPECIALTY TELECOM CIRCUIT, PBGA48
封裝： 5 X 5 X 0.80 MM, PLASTIC, TFBGA-48
文件頁(yè)數(shù)： 11/28頁(yè)
文件大?。?/td> 121K
代理商： PCF26100ET
2001 Jun 19
11
Philips Semiconductors
Preliminary specification
Bluetooth Adapter IC
PCF26100
6.3.2
R
ESET
The PCF26100 is reset with a Power-on reset using the
VIO_POWER signal. This will reset all registers and put
the device into a known state. The POR_EXT reset signal
will also reset the device and put it in the same state as the
Power-on reset. However, POR_EXT is intended to be
used for a reset from a host.
Following the Power-on reset or a reset by POR_EXT, the
system oscillator is started and the SYS_CLK output is
activated (enabled). The SYS_CLK output can be
controlledbytheSYS_CLK_REQsignalbutonlyifthe‘rdy’
bit in the Control Register has been set to logic 1.
The function of SYS_CLK_REQ has 2 phases:
1.
After reset, SYS_CLK_REQ is not taken into account
forthegenerationofSYS_CLK.Afterresetthe13 MHz
system clock is enabled on SYS_CLK.
2.
Once the ‘rdy’ bit is set to logic 1, the 13 MHz clock on
the SYS_CLK is controlled with SYS_CLK_REQ.
The SYS_CLK_REQ signal will not control or disable the
oscillator.
The LPO_CLK output is only controlled by the POR_EXT
signal which also controls the POR output. The POR is
activated 4 SYS_CLK cycles after POR_EXT.
handbook, full pagewidth
MGT755
phase 1 Rdy = 0
phase 2 Rdy = 1
POR
VIO_POWER
LPO_CLK
SYS_CLK_REQ
SYS_CLK
OSC
POR_EXT
Fig.4 Reset timing.
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