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參數(shù)資料
| 型號(hào)： | OCX160-PPT |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | OCX160 Crosspoint Switch |
| 中文描述： | OCX160交叉點(diǎn)開關(guān) |
| 文件頁數(shù)： | 27/44頁 |
| 文件大小： | 710K |
| 代理商： | OCX160-PPT |
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OCX160 Crosspoint Switch
—
Preliminary Data Sheet
I-Cube, Inc.
[Rev. 1.6] 2/20/01
27
4.5
AC Electrical Specifications
(V
DD
.IN = 3.3V ±10%, V
DD
.CORE = 2.5V ±5%)
NOTES:
1.
These parameters are guaranteed but not tested in production.
Table 21
AC Electrical Specifications
0
°
C to 70
°
C
-40
°
C to +85
°
C
Symbol
Parameter
Min
Max
Min
Max
Units
R
DATA
F
RO
t
W_RO
t
S_RO
t
H_RO
t
CO_RO
t
PHL
, t
PLH
t
W+
t
W-
t
DCD+
, t
DCD-
t
JITTER
t
SK
t
PHZ_OT
,
t
PLZ_OT
t
PZH_OT
,
t
PZL_OT
t
RC
t
W+_RC
t
W-_RC
t
S_RC
t
H_RC
t
P_UD
f
JTAG
t
W_JTAG
t
S_JTAG
t
H_JTAG
t
P_JTAG
NRZ Data Rate
(1)
Registered Output Clock Frequency
(1)
Registered Clock Pulse Width, High or Low
(1)
667
667
Mb/s
333
333
MHz
2
2
ns
Registered Output Setup Time to Clock
4
4
ns
Registered Output Clock to Hold Data
0
0
ns
Registered Output Clock to Data Out Valid
2.5
2.5
ns
One Way Signal Propagation Delay, Fanout = 1
5.5
6.5
ns
Input Flow-through Positive Pulse Width
1.5
1.5
ns
Input Flow-through Negative Pulse Width
1.5
1.5
ns
Duty Cycle Distortion
0.5
0.6
ns
Output Jitter
Skew between Output Ports
(1)
TBD
TBD
TBD
TBD
ps
0.5
0.6
ns
Output Enable to Valid Data
3
3
ns
Output Enable to High Z State
3
3
ns
RapidConfigure Clock Period
12
12
ns
RapidConfigure Clock Pulse Width
5
5
ns
RapidConfigure Address Setup to RC_CLK#
3
4
ns
RapidConfigure Address and Enable Hold Time to RC_CLK#
3
4
ns
Update of Crosspoint to Data Out
10
10
ns
JTAG Clock Frequency (TCK)
20
20
MHz
JTAG Clock Pulse Width (TCK) @ 20MHz cycle
20
30
20
30
ns
JTAG Setup Time
4
4
ns
JTAG Hold Time
0
0
ns
JTAG Clock to Output Data Valid (TDO)
20
20
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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