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參數(shù)資料
| 型號： | NCN6004AFTBR2G |
| 廠商： | ON Semiconductor |
| 文件頁數(shù)： | 16/40頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC INTERFACE SAM/SIM DUAL 48TQFP |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 應(yīng)用： | PC，PDA |
| 接口： | 微控制器 |
| 電源電壓： | 1.8 V ~ 5.5 V |
| 封裝/外殼： | 48-TQFP 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 48-TQFP（7x7） |
| 包裝： | 標(biāo)準(zhǔn)包裝 |
| 安裝類型： | 表面貼裝 |
| 其它名稱： | NCN6004AFTBR2GOSDKR |
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NCN6004A
http://onsemi.com
23
When the output voltage reaches the specified value
(1.80 V or 3.0 V or 5.0 V), Q1 and Q16 are switched
OFF immediately to avoid over voltage on the output
load. In the mean time, the two extra NMOS Q2 and
Q3 are switched ON to fully discharge any current
stored into the inductor, avoiding ringing and
voltage spikes over the system. Figure 16 illustrates
the theoretical basic waveforms present in the
DC/DC converter.
The control block gives the logic states according to the
bits provided by the external
mP. These controls bits are
applied to the selected DC/DC converter to generate the
programmed output voltage. The MOS drive block includes
the biases necessaries to drive the NMOS and PMOS
devices as depicted in the block diagram given Figure 15.
U1
R2
R3
R4
Vref
LOGIC
CONTROL
#
A
V0
PWR_ON
Overload
VCC_OK
Voltage Regulation
GND
Vcc
Vref_1.8/3/5 V
PGM
CARD_SEL
A0
A1
A2
DC/DC
MUL
TIPLEXED
CONTROLS
PWR_ON
A3
Q1
Q4
Q15
Q16
L1
C1
Vcc
PWR_GND
CRD_VCC_A
GND
MIXED
LOGIC
/
ANALOG
BLOCK
G_Q1
G_Q2
G_Q3
G_Q4
G_HIZ
GND
G_Q7
Q3
Q2
Q5
V1
V
out
R1
Q7
Q6
5.0 V
GND
Figure 15. Basic DC/DC Converter Diagram
CS
10
mF
C2
GND
10
mF
GND
22
mH
29
27
26
25
28
U2
R6
R7
R8
Vref
LOGIC
CONTROL
#
A
V0
PWR_ON
Overload
VCC_OK
Voltage Regulation
GND
Vcc
Vref_1.8/3/5 V
Q8
Q11
Q17
Q18
L2
C3
Vcc
PWR_GND
CRD_VCC
GND
MIXED
LOGIC
/
ANALOG
BLOCK
G_Q1
G_Q2
G_Q3
G_Q4
G_HIZ
GND
G_Q7
Q10
Q9
Q12
V1
V
out
R5
Q14
Q13
3.0 V
5.0 V
GND
10
mF
C4
GND
10
mF
GND
22
mH
32
34
35
36
33
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PDF描述 |
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參數(shù)描述 |
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