參數(shù)資料
型號(hào)： MT48LC4M32LFFC
廠商： Micron Technology, Inc.
英文描述： SYNCHRONOUS DRAM
中文描述： 同步DRAM
文件頁(yè)數(shù)： 47/52頁(yè)
文件大小： 1281K
代理商： MT48LC4M32LFFC
47
128Mb: x32 SDRAM
128MbSDRAMx32_D.p65 – Rev. D; Pub. 6/02
Micron Technology, Inc., reserves the right to change products or specifications without notice.
2002, Micron Technology, Inc.
128Mb: x32
SDRAM
WRITE – WITHOUT AUTO PRECHARGE
1
NOTE:
1. For this example, the burst length = 4, and the WRITE burst is followed by a “manual” PRECHARGE.
2. Faster frequencies require two clocks (when
t
WR >
t
CK).
3. A8, A9, and A11 = “Don’t Care.”
4.
t
WR of 1 CLK available if running 100 MHz or slower. Check factory for availability.
*CAS latency indicated in parentheses.
-6
-7
SYMBOL*
t
CMH
t
CMS
t
DH
t
DS
t
RAS
t
RC
t
RCD
t
RP
t
WR
4
MIN
1
1.5
1
1.5
42
60
18
18
12
MAX
MIN
1
2
1
2
42
70
20
20
14
MAX
UNITS
ns
ns
ns
ns
ns
ns
ns
ns
ns
120,000
120,000
TIMING PARAMETERS
-6
-7
SYMBOL*
t
AH
t
AS
t
CH
t
CL
t
CK (3)
t
CK (2)
t
CK (1)
t
CKH
t
CKS
MIN
1
1.5
2.5
2.5
6
10
20
1
2
MAX
MIN
1
2
2.75
2.75
7
10
20
1
2
MAX
UNITS
ns
ns
ns
ns
ns
ns
ns
ns
ns
DISABLE AUTO PRECHARGE
ALL BANKs
tCH
tCL
tCK
tRP
tRAS
tRC
tRCD
CKE
CLK
DQ
A10
tCMH
tCMS
tAH
tAS
ROW
ROW
BANK
BANK
BANK
ROW
ROW
BANK
tWR
DON T CARE
D
IN
m
tDH
tDS
D
IN
m
+ 1
D
IN
m
+ 2
D
IN
m
+ 3
COMMAND
tCMH
tCMS
NOP
NOP
NOP
ACTIVE
NOP
WRITE
NOP
PRECHARGE
ACTIVE
tAH
tAS
tAH
tAS
tDH
tDS
tDH
tDS
tDH
tDS
SINGLE BANK
tCKH
tCKS
COLUMN
m
3
2
T0
T1
T2
T4
T3
T5
T6
T7
T8
DQM 0-3
BA0, BA1
A0-A9, A11
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PDF描述
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