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參數(shù)資料
| 型號： | mPD705101GM-100-8ED |
| 廠商： | NEC Corp. |
| 英文描述： | V831TM 32-BIT MICROPROCESSOR |
| 中文描述： | V831TM 32位微處理器 |
| 文件頁數(shù)： | 21/72頁 |
| 文件大?。?/td> | 302K |
| 代理商： | MPD705101GM-100-8ED |
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μ
PD705101
21
9.3 Baud Rate Generator (BRG)
9.3.1 Configuration and function
The serial interface can use the serial clock output by the baud rate generator or the divided value of
φ
(bus clock)
as a baud rate.
The serial clock source is specified by the following registers.
In the case of UART : Specified by the SCLS0 bit of the ASIM00 register.
In the case of CSI
The baud rate generator is shared by the UART and CSI.
: Specified by the CLS02 through CLS00 bits of the CSIM0 register.
The configuration of the baud rate generator (BRG) is shown below.
Figure 9-3. Block Configuration of Baud Rate Generator (BRG)
Remark
φ
= bus clock (33 M to 16.7 MHz)
Compare
register
Internal peripheral I/O bus
BRG0
Internal timer
TMBRG0
Serial interface
(UART/CSI)
BPR00 - 02
BRCE0
BPRM0
Prescaler
1/2
φ
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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