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參數(shù)資料
| 型號： | MD80C52TXXX-25SCD |
| 廠商： | ATMEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 25 MHz, MICROCONTROLLER, CDIP40 |
| 封裝： | 0.600 INCH, CERAMIC, DIP-40 |
| 文件頁數(shù)： | 162/395頁 |
| 文件大?。?/td> | 9022K |
| 代理商： | MD80C52TXXX-25SCD |
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244
ATmega64A [DATASHEET]
8160D–AVR–02/2013
The active states are:
Capture-DR: Data in the IDCODE Register is sampled into the Boundary-scan Chain.
Shift-DR: The IDCODE scan chain is shifted by the TCK input.
26.4.3
SAMPLE_PRELOAD; 0x2
Mandatory JTAG instruction for taking a snap-shot of the input/output pins without affecting the system operation,
and pre-loading the output latches. However, the output latches are not connected to the pins. The Boundary-scan
Chain is selected as data register.
The active states are:
Capture-DR: Data on the external pins are sampled into the Boundary-scan Chain.
Shift-DR: The Boundary-scan Chain is shifted by the TCK input.
Update-DR: Data from the Boundary-scan Chain is applied to the output latches. However, the output latches
are not connected to the pins.
26.4.4
AVR_RESET; 0xC
The AVR specific public JTAG instruction for forcing the AVR device into the Reset mode or releasing the JTAG
Reset source. The TAP controller is not reset by this instruction. The one bit Reset Register is selected as data
register. Note that the reset will be active as long as there is a logic “one” in the Reset Chain. The output from this
chain is not latched.
The active states are:
Shift-DR: The Reset Register is shifted by the TCK input.
26.4.5
BYPASS; 0xF
Mandatory JTAG instruction selecting the Bypass Register for Data Register.
The active states are:
Capture-DR: Loads a logic “0” into the Bypass Register.
Shift-DR: The Bypass Register cell between TDI and TDO is shifted.
26.5
Boundary-scan Chain
The Boundary-scan Chain has the capability of driving and observing the logic levels on the digital I/O pins, as well
as the boundary between digital and analog logic for analog circuitry having Off-chip connection.
26.5.1
Scanning the Digital Port Pins
Figure 26-3 shows the Boundary-scan Cell for a bi-directional port pin with pull-up function. The cell consists of a
standard Boundary-scan cell for the Pull-up Enable – PUExn – function, and a bi-directional pin cell that combines
the three signals, Output Control – OCxn, Output Data – ODxn, and Input Data – IDxn, into only a two-stage Shift
Register. The port and pin indexes are not used in the following description.
The Boundary-scan logic is not included in the figures in this Datasheet. Figure 26-4 shows a simple digital Port
Pin as described in the section “I/O Ports” on page 65. The Boundary-scan details from Figure 26-3 replaces the
dashed box in Figure 26-4.
When no alternate port function is present, the Input Data – ID corresponds to the PINxn Register value (but ID has
no synchronizer), Output Data corresponds to the PORT Register, Output Control corresponds to the Data Direc-
tion – DD Register, and the Pull-up Enable – PUExn – corresponds to logic expression PUD DDxn PORTxn.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MD80C52CXXX-12SHXXX | 8-BIT, MROM, 12 MHz, MICROCONTROLLER, CDIP40 |
| MR80C52XXX-16P883 | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CQCC44 |
| MF280C51-12R | 8-BIT, MROM, 12 MHz, MICROCONTROLLER, PQFP44 |
| M43C505F | 4-BIT, MROM, 2 MHz, MICROCONTROLLER |
| MQ80C32-20/883R | 8-BIT, 20 MHz, MICROCONTROLLER, CQFP44 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MD80C86 | 制造商:INTERSIL 制造商全稱:Intersil Corporation 功能描述:CMOS 16-Bit Microprocessor |
| MD80C862 | 制造商:Intel 功能描述:PROCESSOR:MICRO-PROCESSOR |
| MD80C86-2 | 制造商:INTERSIL 制造商全稱:Intersil Corporation 功能描述:CMOS 16-Bit Microprocessor |
| MD80C86-2/883 | 制造商:Intersil Corporation 功能描述:MPU 16BIT CMOS 8MHZ 40CDIP - Rail/Tube 制造商:Rochester Electronics LLC 功能描述:CPU 16BILT 5V CMOS 8MHZ 40CDIP - Bulk |
| MD80C86-2/B | 制造商:Intersil Corporation 功能描述:MPU 16BIT CMOS 8MHZ 40CDIP - Rail/Tube |
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