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參數(shù)資料
| 型號： | MAX3624AETJ+ |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 2/12頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLOCK GENERATOR PREC 32TQFN |
| 產品培訓模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標準包裝： | 60 |
| 類型： | 時鐘發(fā)生器，扇出配送，多路復用器 |
| PLL： | 帶旁路 |
| 輸入： | LVCMOS，LVTTL |
| 輸出： | LVCMOS，LVPECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:4 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 648MHz |
| 除法器/乘法器： | 是/是 |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-WFQFN 裸露焊盤 |
| 供應商設備封裝： | 32-TQFN-EP（5x5） |
| 包裝： | 托盤 |
MAX3624A
Low-Jitter, Precision Clock Generator
with Four Outputs
10
______________________________________________________________________________________
Interfacing with LVPECL Outputs
The equivalent LVPECL output circuit is given in Figure
8. These outputs are designed to drive a pair of 50
Ω
transmission lines terminated with 50
Ω to VTT = VCC -
2V. If a separate termination voltage (VTT) is not avail-
able, other termination methods can be used such as
shown in Figure 5 and Figure 6. Unused outputs should
be disabled and may be left open. For more information
on LVPECL terminations and how to interface with other
logic families, refer to Application Note 291:
HFAN-
01.0: Introduction to LVDS, PECL, and CML.
Figure 7, Figure 8, and Figure 9 show examples of
interface models.
MAX3624A Qx
82
Ω
Z0 = 50
Ω
Qx
Z0 = 50
Ω
82
Ω
130
Ω
130
Ω
+3.3V
HIGH
IMPEDANCE
Figure 5. Thevenin Equivalent of Standard PECL Termination
14.5k
Ω
VB
ESD
STRUCTURES
VB
REF_IN
VB = 1.4V
VCC
Figure 7. Simplified REF_IN Pin Circuit Schematic
ESD
STRUCTURES
Qx
VCC
Qx
Figure 8. Simplified LVPECL Output Circuit Schematic
MAX3624A
Qx
150
Ω
100
Ω
Qx
Z0 = 50
Ω
Z0 = 50
Ω
HIGH
IMPEDANCE
150
Ω
0.1
μF
NOTE: AC-COUPLING IS OPTIONAL.
0.1
μF
Figure 6. AC-Coupled PECL Termination
Interface Models
相關PDF資料 |
PDF描述 |
|---|---|
| VI-J2H-MZ-F4 | CONVERTER MOD DC/DC 52V 25W |
| VE-J5H-MX-B1 | CONVERTER MOD DC/DC 52V 75W |
| VI-2TT-MW-F1 | CONVERTER MOD DC/DC 6.5V 100W |
| VE-J5F-MX-B1 | CONVERTER MOD DC/DC 72V 75W |
| VI-J2H-MZ-F3 | CONVERTER MOD DC/DC 52V 25W |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MAX3624AETJ+ | 功能描述:時鐘發(fā)生器及支持產品 Low Jitter Precision w/Four Outputs RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:QFN-56 |
| MAX3624AETJ+T | 功能描述:時鐘發(fā)生器及支持產品 Low Jitter Precision w/Four Outputs RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:QFN-56 |
| MAX3624AEVKIT+ | 制造商:Microsemi Corporation 功能描述:MAX3624A EVALUATION KIT - Boxed Product (Development Kits) 制造商:MICROSEMI CONSUMER MEDICAL PRODUCT GROUP 功能描述:KIT EVALUATION MAX MAX3624A 制造商:Microsemi Corporation 功能描述:KIT EVALUATION MAX MAX3624A |
| MAX3624EVKIT+ | 制造商:Microsemi Corporation 功能描述:MAX3624 EVALUATION KIT - Boxed Product (Development Kits) 制造商:MICROSEMI CONSUMER MEDICAL PRODUCT GROUP 功能描述:KIT EVALUATION MAX MAX3624 制造商:Microsemi Corporation 功能描述:KIT EVALUATION MAX MAX3624 |
| MAX3624UTJ+ | 功能描述:時鐘發(fā)生器及支持產品 RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:QFN-56 |
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