參數(shù)資料
型號(hào)： MAX3624AETJ+
廠商： Maxim Integrated Products
文件頁(yè)數(shù)： 11/12頁(yè)
文件大小： 0K
描述： IC CLOCK GENERATOR PREC 32TQFN
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 60
類型： 時(shí)鐘發(fā)生器，扇出配送，多路復(fù)用器
PLL： 帶旁路
輸入： LVCMOS，LVTTL
輸出： LVCMOS，LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 2:4
差分 - 輸入:輸出： 無(wú)/是
頻率 - 最大： 648MHz
除法器/乘法器： 是/是
電源電壓： 3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 32-WFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝： 32-TQFN-EP（5x5）
包裝： 托盤
MAX3624A
Low-Jitter, Precision Clock Generator
with Four Outputs
8
_______________________________________________________________________________________
Output Divider Configuration
Table 2 shows the input settings required to set the out-
put dividers. Leakage in the open case must be less
than 1A. Note that when the MAX3624A is in bypass
mode (BYPASS set low), the output dividers are auto-
matically set to divide by 1.
Table 2. Output Divider Configuration
INPUT
SELA1/SELB1
SELA0/SELB0
NA/NB DIVIDER
0
÷2*
0
1
÷3*
1
0
÷4
1
÷5
1
Open
÷6
Open
1
÷8
0
Open
÷10
Open
0
÷12
Open
÷1*
Table 1. Output Frequency Determination
XO OR CMOS
INPUT
FREQUENCY
(MHz)
FEEDBACK
DIVIDER, M
VCO
FREQUENCY
(MHz)
OUTPUT
DIVIDER,
NA AND NB
OUTPUT
FREQUENCY
(MHz)
APPLICATIONS
÷2
312.5
÷4
156.25
÷5
125
÷8
78.125
25
625
÷10
62.5
Ethernet
25.78125
25
644.53125
÷4
161.132812
10Gbps Ethernet
÷2
312.5
÷4
156.25
÷5
125
÷8
78.125
26.04166
24
625
÷10
62.5
Ethernet
÷2
318.75
÷3
212.5
÷4
159.375
÷6
106.25
26.5625
24
637.5
÷12
53.125
Fibre Channel
÷2
311.04
÷4
155.52
19.44
32
622.08
÷8
77.76
SONET/SDH
÷2
311.04
÷4
155.52
38.88
(CMOS input)
16
622.08
÷8
77.76
SONET/SDH
*
Maximum guaranteed output frequency is 160MHz for CMOS
and 320MHz for LVPECL output.
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PDF描述
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參數(shù)描述
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