參數(shù)資料
型號： M69030
元件分類： 圖形處理器
英文描述： GRAPHICS PROCESSOR, PBGA278
文件頁數(shù)： 52/387頁
文件大?。?/td> 2678K
代理商： M69030
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CRT Controller Registers
9-43
`efmp69030 Databook
Revision 1.3 11/24/99
CR77
NTSC/PAL Filtering Control Register
read/write at I/O address 3B5h/3D5h with index at address 3B4h/3D4h set to 77h
shadowed only for pipeline B
7
VGA Text Mode Scanline Halving
0: Disables VGA text mode scanline halving.
1: Enables VGA text mode scanline halving, where the setting carried in the Maximum
Scanline Register (CR09) and that carried by bits 4-0 of the Text Cursor End Register
(CR0B) are halved. This is done to cut the number of scanlines actually sent to the display
from VGA standard quantities (such as 400) down to quantities that are more manageable
for televisions (such as 200) without actually programming CR09 and bits 4-0 of CR0B with
values that are different from VGA standards. This function is meant to be used in
conjunction with character fonts that are only half as high as those normally used in VGA
text modes.
6-4
Reserved (Writable)
These bits should always be written with the value of 0.
3
Horizontal Flicker Reduction Filtering Enable
Note: Bits 1 and 0 of this register must both be set to 1 in order to enable the flicker
reduction filtering hardware, before horizontal flicker reduction filtering can be enabled
through this bit.
0: Disables horizontal flicker reduction filtering
1: Enables horizontal flicker reduction filtering where the current pixel is averaged with the
pixels immediately to the left and right on the same scanline. This averaging process uses
weighted averaging. The current pixel’s value is divided by 2, the values of each of the two
adjacent pixels is divided by 4, and the resulting three values are added to create the value
that is displayed.
2
Vertical Flicker Reduction Filtering Enable
Note: Bits 1 and 0 of this register must both be set to 1 in order to enable the flicker
reduction filtering hardware, before vertical flicker reduction filtering can be enabled
through this bit.
0: Disables vertical flicker reduction filtering
1: Enables vertical flicker reduction filtering where the pixels of the current scanline are
averaged with the pixels of the next scanline as the pixels of the current scanline are being
displayed.
1
Internal Clock Doubling Enable
0: One of the internal clocks used by the graphics controller remains at normal clock rates.
1: One of the internal clocks used by the graphics controller is doubled in frequency.
0
Flicker Reduction Filtering Enable
Note: Bit 1 of this register should be set to enable the doubling of an internal clock, before
the use of the flicker reduction hardware is enabled by setting this bit to 1.
0: Disables all flicker reduction filter hardware.
1: Enables the use of the flicker reduction filter hardware.
76543
210
A
reserved
B
Text Mode
Line Halving
(0)
Reserved (Writable)
(000)
Hor. Filter
Enable
(0)
Ver. Filter
Enable
(0)
Clk
Doubling
Enable
(0)
Filtering
Enable
(0)
相關PDF資料
PDF描述
MA4T85633 C BAND, Si, NPN, RF SMALL SIGNAL TRANSISTOR
MA4T85600 Si, RF POWER TRANSISTOR
MA4T85635 C BAND, Si, NPN, RF SMALL SIGNAL TRANSISTOR
MAT-02NBC 20 mA, 40 V, 2 CHANNEL, NPN, Si, SMALL SIGNAL TRANSISTOR
MAT-02NBCG 20 mA, 40 V, 2 CHANNEL, NPN, Si, SMALL SIGNAL TRANSISTOR
相關代理商/技術參數(shù)
參數(shù)描述
M69032 制造商:MITSUBISHI 制造商全稱:Mitsubishi Electric Semiconductor 功能描述:
M690SDM 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:SIGE SINGLE FREQUENCY VCSO
M690SDM-R01 功能描述:時鐘合成器/抖動清除器 VCSO RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
M690SDM-R02 功能描述:時鐘合成器/抖動清除器 VCSO RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
M690SDM-R03 功能描述:時鐘合成器/抖動清除器 RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
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