參數(shù)資料
型號(hào)： LFXP2-17E-7F484C
廠商： LATTICE SEMICONDUCTOR CORP
元件分類： FPGA
中文描述： FPGA, 420 MHz, PBGA484
封裝： 23 X 23 MM, FPBGA-484
文件頁數(shù)： 53/92頁
文件大?。?/td> 1701K
代理商： LFXP2-17E-7F484C
3-13
DC and Switching Characteristics
Lattice Semiconductor
LatticeXP2 Family Data Sheet
MLVDS
The LatticeXP2 devices support the differential MLVDS standard. This standard is emulated using complementary
LVCMOS outputs in conjunction with a parallel resistor across the driver outputs. The MLVDS input standard is
supported by the LVDS differential input buffer. The scheme shown in Figure 3-5 is one possible solution for
MLVDS standard implementation. Resistor values in Figure 3-5 are industry standard values for 1% resistors.
Figure 3-5. MLVDS (Reduced Swing Differential Standard)
Table 3-5. MLVDS DC Conditions
1
For further information on LVPECL, RSDS, MLVDS, BLVDS and other differential interfaces please see details of
additional technical information at the end of this data sheet.
Parameter
Description
Typical
Units
Zo=50
Zo=70
VCCIO
Output Driver Supply (+/-5%)
2.50
V
ZOUT
Driver Impedance
10.00
RS
Driver Series Resistor (+/-1%)
35.00
RTL
Driver Parallel Resistor (+/-1%)
50.00
70.00
RTR
Receiver Termination (+/-1%)
50.00
70.00
VOH
Output High Voltage (After RTL)1.52
1.60
V
VOL
Output Low Voltage (After RTL)0.98
0.90
V
VOD
Output Differential Voltage (After RTL)0.54
0.70
V
VCM
Output Common Mode Voltage
1.25
V
IDC
DC Output Current
21.74
20.00
mA
1. For input buffer, see LVDS table.
16mA
2.5V
+
-
2.5V
+
-
2.5V
+
-
. . .
A
m
6
1
Heavily loaded backplace, effective Zo~50 to 70 ohms differential
50 to 70 ohms +/-1%
RS =
35ohms
RS =
35ohms
RS =
35ohms
RS =
35ohms
RS =
35ohms
RS =
35ohms
RS =
35ohms
RS =
35ohms
RTR
RTL
16mA
2.5V
A
m
6
1
2.5V
+
-
A
m
6
1
2.5V
A
m
6
1
2.5V
+
-
16mA
相關(guān)PDF資料
PDF描述
LFXP20E-3FN484C
LFXP20E-5FN484C
LFXP15C-4FN256C
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LFZ2805HXX GENERAL PURPOSE INDUCTOR
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參數(shù)描述
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