參數(shù)資料
型號： LFSCM3GA80EP1-6FCN1704C
廠商： LATTICE SEMICONDUCTOR CORP
元件分類： FPGA
中文描述： FPGA, 308 CLBS, 80000 GATES, 1000 MHz, CBGA1704
封裝： 42.5 X 42.5 MM, LEAD FREE, CERAMIC, FCBGA-1704
文件頁數(shù)： 112/243頁
文件大小： 2674K
代理商： LFSCM3GA80EP1-6FCN1704C
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January 2010
Data Sheet DS1004
2010 Lattice Semiconductor Corp. All Lattice trademarks, registered trademarks, patents, and disclaimers are as listed at www.latticesemi.com/legal. All other brand
or product names are trademarks or registered trademarks of their respective holders. The specifications and information herein are subject to change without notice.
www.latticesemi.com
1-1
DS1004 Introduction_01.7
Features
High Performance FPGA Fabric
15K to 115K four input Look-up Tables (LUT4s)
139 to 942 I/Os
700MHz global clock; 1GHz edge clocks
4 to 32 High Speed SERDES and flexiPCS
(per Device)
Performance ranging from 600Mbps to 3.8Gbps
Excellent Rx jitter tolerance (0.8UI at
3.125Gbps)
Low Tx jitter (0.25UI typical at 3.125Gbps)
Built-in Pre-emphasis and equalization
Low power (typically 105mW per channel)
Embedded Physical Coding Sublayer (PCS)
provides pre-engineered implementation for the
following standards:
– GbE, XAUI, PCI Express, SONET, Serial Rapi-
dIO, 1G Fibre Channel, 2G Fibre Channel
2Gbps High Performance PURESPEED I/O
Supports the following performance bandwidths
– Differential I/O up to 2Gbps DDR
(1GHz Clock)
– Single-ended memory interfaces up to
800Mbps
144 Tap programmable Input Delay (INDEL)
block on every I/O dynamically aligns data to
clock for robust performance
– Dynamic bit Adaptive Input Logic (AIL) mon-
itoring and control circuitry per pin that auto-
matically ensures proper set-up and hold
– Dynamic bus: uses control bus from DLL
– Static per bit
Electrical standards supported:
– LVCMOS 3.3/2.5/1.8/1.5/1.2, LVTTL
– SSTL 3/2/18 I, II; HSTL 18/15 I, II
– PCI, PCI-X
– LVDS, Mini-LVDS, Bus-LVDS, MLVDS,
LVPECL, RSDS
Programmable On Die Termination (ODT)
– Includes Thevenin Equivalent and low
power VTT termination options
Memory Intensive FPGA
sysMEM embedded Block RAM
– 1 to 7.8 Mbits memory
– True Dual Port/Pseudo Dual Port/Single
Port
– Dedicated FIFO logic for all block RAM
– 500MHz performance
Additional 240K to 1.8Mbits distributed RAM
sysCLOCK Network
Eight analog PLLs per device
– Frequency range from 15MHz to 1GHz
– Spread spectrum support
12 DLLs per device with direct control of I/O
delay
– Frequency range from 100MHz to 700MHz
Extensive clocking network
– 700MHz primary and 325 MHz secondary
clocks
– 1GHz I/O-connected edge clocks
Precision Clock Divider
– Phase matched x2 and x4 division of incom-
ing clocks
Dynamic Clock Select (DCS)
– Glitch free clock MUX
Masked Array for Cost Optimization
(MACO) Blocks
On-chip structured ASIC Blocks provide pre-
engineered IP for low power, low cost system
level integration
High Performance System Bus
Ties FPGA elements together with a standard
bus framework
– Connects to peripheral user interfaces for
run-time dynamic configuration
System Level Support
IEEE standard 1149.1 Boundary Scan, plus
ispTRACY internal logic analyzer
IEEE Standard 1532 in-system configuration
1.2V and 1.0V operation
Onboard oscillator for initialization and general
use
Embedded PowerPC microprocessor interface
Low cost wire-bond and high pin count flip-chip
packaging
Low cost SPI Flash RAM configuration
LatticeSC/M Family Data Sheet
Introduction
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PDF描述
LFSC3GA15E-6FN256I
LFSCM3GA40EP1-5FFN1020I
LFXP2-40E-6FN484I
LFXP2-17E-7F484C
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參數(shù)描述
LFSCM3GA80EP1-6FCN1704I 功能描述:FPGA - 現(xiàn)場可編程門陣列 80.1K LUTs 904 I/O MACOSERDES 1.2V -6I RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
LFSCM3GA80EP1-6FF1152C 功能描述:FPGA - 現(xiàn)場可編程門陣列 80.1K LUTs 660 I/O MACO SERDES1.2V -6SP RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
LFSCM3GA80EP1-6FF1152I 功能描述:FPGA - 現(xiàn)場可編程門陣列 80.1K LUTs 660 I/O MACO SERDES1.2V -6SP RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
LFSCM3GA80EP1-6FF1704C 功能描述:FPGA - 現(xiàn)場可編程門陣列 80.1K LUTs 904 I/O MACO SERDES1.2V -6SP RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
LFSCM3GA80EP1-6FF1704I 功能描述:FPGA - 現(xiàn)場可編程門陣列 80.1K LUTs 904 I/O MACO SERDES1.2V -6SP RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
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