參數(shù)資料
型號(hào)： LFSCM3GA40EP1-5FFN1020I
廠商： LATTICE SEMICONDUCTOR CORP
元件分類： FPGA
中文描述： FPGA, 216 CLBS, 40000 GATES, 1000 MHz, PBGA1020
封裝： 33 X 33 MM, LEAD FREE, FCBGA-1020
文件頁(yè)數(shù)： 212/243頁(yè)
文件大?。?/td> 2674K
代理商： LFSCM3GA40EP1-5FFN1020I
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3-26
DC and Switching Characteristics
Lattice Semiconductor
LatticeSC/M Family Data Sheet
sysCLOCK DLL Timing
Over Recommended Operating Conditions
Parameter
Description
Conditions
Min.
Typ.
Max.
Units
fIN
Input Clock Frequency (CLKI, CLKFB)
100
—
700
MHz
fOUTOP
Output Clock Frequency (CLKOP)
100
—
700
MHz
fOUTOS
Output Clock Frequency (CLKOS)
25
—
700
MHz
AC Characteristics
tDUTY
Output Clock Duty Cycle
Output Clock Duty Cycle (at 50%
levels, 50% duty cycle input clock,
duty cycle correction turned off,
time reference delay mode)
38
—
62
%
tDUTYRD
Output Clock Duty Cycle
Output Clock Duty Cycle (at 50%
levels, arbitrary duty cycle input
clock, duty cycle correction turned
on, time reference delay mode)
45
—
55
%
tDUTYCIR
Output Clock Duty Cycle
Output Clock Duty Cycle (at 50%
levels, arbitrary duty cycle input
clock, duty cycle correction turned
on, clock injection removal mode)
40
—
60
%
tOPJIT
1
Output Clock Period Jitter
—
200
ps
tCPJIT
1
Output Clock Cycle-to-Cycle Jitter
—
200
ps
tSKEW
Output Clock to Clock Skew (Between
Two Outputs with the Same Phase
Setting)
——
100
ps
tLOCK
DLL Lock-in Time
8
—
18500
cycles
tIDUTY
Input Clock Duty Cycle
Applies to all operating conditions
35
—
65
%
tIPJIT
Input Clock Period Jitter
—
+/- 250
ps
tHI
Input Clock High Time
At 80% level
500
—
ps
tLO
Input Clock Low Time
At 20% level
500
—
ps
tRSWD
Reset Signal Pulse Width
3
—
ns
tFDEL
Timeshift Delay Step Size
35
45
80
ps
tDLL
Delay Through the DLL when No Delay
Taps are Chosen but Not in Bypass
Mode.
—760
—
ps
1. Values are measured with FPGA logic active, no additional I/Os toggling and REFCLK total jitter = 30 ps.
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PDF描述
LFXP2-40E-6FN484I
LFXP2-17E-7F484C
LFXP20E-3FN484C
LFXP20E-5FN484C
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參數(shù)描述
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LFSCM3GA40EP1-6FC1152I 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 40.4K LUTs 604 I/O MACO SERDES 1.2V -6I RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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