參數(shù)資料
型號： KSZ8841-PMQL-EVAL
廠商： Micrel Inc
文件頁數(shù)： 48/74頁
文件大?。?/td> 0K
描述： BOARD EVALUATION KSZ8841-PMQL
標準包裝： 1
主要目的： 接口，以太網(wǎng)控制器（PHY 和 MAC）
嵌入式： 否
已用 IC / 零件： KSZ8841-PMQL
主要屬性： 1 個端口，100BASE-TX/10BASE-T
次要屬性： PCI 接口，LinkMD 線纜診斷
已供物品： 板
產(chǎn)品目錄頁面： 1114 (CN2011-ZH PDF)
相關產(chǎn)品： 576-2118-ND - IC MAC CTRLR 32BIT PCI 128-PQFP
576-2117-ND - IC MAC CTRLR 32BIT 128-PQFP
其它名稱： 576-1633
Micrel, Inc.
KSZ8841-PMQL
October 2007
52
M9999-100407-1.5
Wakeup Frame 3 Byte Mask 0 Register (Offset 0x0254): WF3BM0
This register contains the first 16 bytes mask values of the Wake up frame 3 pattern. Setting bit 0 selects the first byte
of the Wake up frame 3; setting bit 15 selects the 16th byte of the Wake up frame 3.
Bit
Default
R/W
Description
15 - 0
--
RW
WF3BM0
Wake up Frame 3 Byte Mask 0
The first 16bytes mask of a wake up frame 3 pattern.
Wakeup Frame 3 Byte Mask 1 Register (Offset 0x0256): WF3BM1
This register contains the next 16bytes mask values of the Wake up frame 3 pattern. Setting bit 0 selects the 17th byte
of the Wake up frame 3; setting bit 15 selects the 32nd byte of the Wake up frame 3.
Bit
Default
R/W
Description
15 - 0
--
RW
WF3BM1
Wake up Frame 3 Byte Mask 1
The next 16bytes mask covering bytes 17 to 32 of a wake up frame 3
pattern.
Wakeup Frame 3 Byte Mask 2 Register (Offset 0x0258): WF3BM2
This register contains the next 16bytes mask values of the Wake up frame 3 pattern. Setting bit 0 selects the 33rd byte
of the Wake up frame 3; setting bit 15 selects the 48th byte of the Wake up frame 3.
Bit
Default
R/W
Description
15 - 0
--
RW
WF3BM2
Wake up Frame 3 Byte Mask 2
The next 16bytes mask covering bytes 33 to 48 of a wake up frame 3
pattern.
Wakeup Frame 3 Byte Mask 3 Register (Offset 0x025A): WF3BM3
This register contains the last 16bytes mask values of the Wake up frame 3 pattern. Setting bit 0 selects the 49th byte
of the Wake up frame 3; setting bit 15 selects the 64th byte of the Wake up frame 3.
Bit
Default
R/W
Description
15 - 0
--
RW
WF3BM2
Wake up Frame 3 Byte Mask 3
The last 16 bytes mask covering bytes 49 to 64 of a wake up frame 3
pattern.
Chip ID and Enable Register (Offset 0x0400): CIDER
This register contains the chip ID, and the chip enables control.
Bit
Default
R/W
Description
15-8
0x88
RO
Family ID
Chip family ID
7-4
0x05
RO
Chip ID
0x05 is assigned to KSZ8841-PMQL
3-1
000
RO
Revision ID
0
-
RW
Start Controller
1 = Start the chip operation
0 = Stop the chip operation
相關PDF資料
PDF描述
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相關代理商/技術參數(shù)
參數(shù)描述
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