參數(shù)資料
型號： ISPMACH4ACPLDFAMILY
廠商： Lattice Semiconductor Corporation
英文描述： High Performance E 2 CMOS In-System Programmable Logic
中文描述： 高的E 2的CMOS在系統(tǒng)可編程邏輯
文件頁數(shù)： 61/62頁
文件大?。?/td> 1180K
代理商： ISPMACH4ACPLDFAMILY
ispMACH 4A Family
61
Most ispMACH devices are dual-marked with both Commercial and Industrial grades. The Industrial speed grade is slower, i.e., M4A3-
256/128-7YC-10YI
Valid Combinations
Valid Combinations list configurations planned to be supported in volume for this device. Consult the local Lattice sales office to
confirm availability of specific valid combinations and to check on newly released combinations.
Copyright
2000 Lattice Semiconductor. All rights reserved.
5V Industrial Combinations
-7, -10, -12
M4A5-32/32
M4A5-64/32
M4A5-96/48
M4A5-128/64
M4A5-192/96
M4A5-256/128
JI, VI, VI48
JI, VI, VI48
VI
YI, VI
VI
YI, AI
-7, -10, -12
-7, -10, -12
-10, -12
5V Commercial Combinations
-5, -7, -10,
M4A5-32/32
M4A5-64/32
M4A5-96/48
M4A5-128/64
M4A5-192/96
M4A5-256/128
JC, VC, VC48
JC, VC, VC48
VC
YC, VC
VC
YC, AC
-55, -7, -10
-6, -7, -10
-65, -7, -10
相關PDF資料
PDF描述
ISPPAC-CLK5520V-01TN100C Linear Array Light; LED Color:Green; Leaded Process Compatible:No; Peak Reflow Compatible (260 C):No; Supply Current:1.6A; Supply Voltage:24VDC; Wavelength:530nm
ISPPAC-CLK55xx In-System Programmable Clock Generator with Universal Fan-Out Buffer
ISPPAC-CLK5510V In-System Programmable Clock Generator with Universal Fan-Out Buffer
ISPPAC-CLK5510V-01T48C In-System Programmable Clock Generator with Universal Fan-Out Buffer
ISPPAC-CLK5510V-01T48I In-System Programmable Clock Generator with Universal Fan-Out Buffer
相關代理商/技術參數(shù)
參數(shù)描述
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ISPNANO-UPG7 功能描述:JTAG ISP UPGRADE FOR ATMEL AVR RoHS:否 類別:編程器，開發(fā)系統(tǒng) >> 知識產(chǎn)權 (IP) 系列:* 標準包裝:1 系列:Nios®II 類型:Nios II 功能:C 到硬件編譯器 許可證:初始許可證
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