參數(shù)資料
型號: FDC37C67X
廠商: STANDARD MICROSYSTEMS CORP
元件分類: 外設(shè)及接口
英文描述: ENHANCED SUPER I/O CONTROLLER WITH FAST IR
中文描述: MULTIFUNCTION PERIPHERAL, PQFP100
封裝: QFP-100
文件頁數(shù): 153/194頁
文件大小: 546K
代理商: FDC37C67X
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Table 64 - Auxilliary I/O, Logical Device 8 [Logical Device Number = 0x08]
NAME
REG
INDEX
Bit[3] Reserved
Bit[4] EN_P12: Enable 8042 P1.2 to route internally
to nSMI. 0=Do not route to nSMI, 1=Enable
routing to nSMI.
Bit[5] Reserved
Bit[6] EN_SMI_S: Enables nSMI Interrupt onto
Serial IRQ.
Bit[7] EN_SMI_P: Enables nSMI Interrupt onto
Parallel Interrupt Pin IRQ10. 0=SMI pin
floats, 1=Output onto nSMI GPI/O pin.
SMI Status
Register 1
inputs.
DEFINITION
STATE
Default = 0x00
on Vcc POR
0xB6 R/W
This register is used to read the status of the SMI
The following bits must be cleared at their source.
Bit[0] Reserved
Bit[1] PINT (Parallel Port Interrupt)
Bit[2] U2INT (UART 2 Interrupt)
Bit[3] U1INT (UART 1 Interrupt)
Bit[4] FINT (Floppy Disk Controller Interrupt)
Bit[5] Reserved
Bit[6] Reserved
Bit[7] WDT (Watch Dog Timer)
This register is used to read the status of the SMI
inputs.
Bit[0] MINT: Mouse Interrupt. Cleared at source.
Bit[1] KINT: Keyboard Interrupt. Cleared at source.
Bit[2] IRINT: This bit is set by a transition on the IR
pin (RDX2 or IRRX as selected in CR L5-F1-
B6 i.e., after the MUX). Cleared by a read of
this register.
Bit[3] Reserved
Bit[4] P12: 8042 P1.2. Cleared at source
Bit[7:5] Reserved
Bits[7:0] Reserved
C
SMI Status
Register 2
Default = 0x00
on Vcc POR
0xB7 R/W
C
Default = 0x00
on VTR POR
Pin Multiplex
Controls
0xB8 R/W
C
Default = 0x06 on
Vcc POR
0xC0
Bit[0] IR Mode Select
Bit[1] DMA 3 Select
Bit[2] Serial IRQ Select
Bit[3] 8042 Select
Bit[4] IRRX 3 Select
Bit[5:7] Reserved
Bit[0] Force Change 0
Force Disk Change
0xC1
C,R
相關(guān)PDF資料
PDF描述
FDC37C957FR ULTRA I/O CONTROLLER FOR PORTABLE APPLICATIONS
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