AVDD = DV
參數(shù)資料
型號(hào)： EVAL-ADF4360-9EBZ1
廠商： Analog Devices Inc
文件頁數(shù)： 20/24頁
文件大?。?/td> 0K
描述： EVALUATION BOARD FOR ADF4360-9
標(biāo)準(zhǔn)包裝： 1
主要目的： 計(jì)時(shí)，頻率合成器
嵌入式： 否
已用 IC / 零件： ADF4360-9
主要屬性： 帶 VCO 的單路整數(shù)-N PLL
次要屬性： 360MHz，1.6MHz PFD
已供物品： 板
其它名稱： Q5254840
Data Sheet
ADF4360-9
Rev. C | Page 5 of 24
TIMING CHARACTERISTICS1
AVDD = DVDD = VVCO = 3.3 V ± 10%; AGND = DGND = 0 V; 1.8 V and 3 V logic levels used; TA = TMIN to TMAX, unless otherwise noted.
Table 2.
Parameter
Limit at TMIN to TMAX (B Version)
Unit
Test Conditions/Comments
t1
20
ns min
LE setup time
t2
10
ns min
DATA to CLK setup time
t3
10
ns min
DATA to CLK hold time
t4
25
ns min
CLK high duration
t5
25
ns min
CLK low duration
t6
10
ns min
CLK to LE setup time
t7
20
ns min
LE pulse width
1
Refer to the Power-Up section for the recommended power-up procedure for this device.
CLK
DATA
LE
DB23 (MSB)
DB22
DB2
DB1
(CONTROL BIT C2)
DB0 (LSB)
(CONTROL BIT C1)
t1
t2
t3
t7
t6
t4
t5
07139-
002
Figure 2. Timing Diagram
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